spirom: fix SPI ROM I/O and data downloading

Fix a number of timing problems in the spirom downloader. It now seems
to work well. However, new problem: execution from sdram?

fpga/Makefile

@@ -21,7 +21,7 @@ QPOW    	= $(QU)_pow $(QOPT)
 
 outdir		= output
 
-PERL    = perl
+PERL		= /usr/bin/perl		# Otherwise Quartus has a cow...
 
 SUBDIRS     = usb
 PREREQFILES = $(outdir)/sram.mif

fpga/max80.qpf

@@ -19,12 +19,12 @@
 #
 # Quartus Prime
 # Version 21.1.0 Build 842 10/21/2021 SJ Lite Edition
-# Date created = 01:12:15  January 28, 2022
+# Date created = 03:59:44  February 02, 2022
 #
 # -------------------------------------------------------------------------- #
 
 QUARTUS_VERSION = "21.1"
-DATE = "01:12:15  January 28, 2022"
+DATE = "03:59:44  February 02, 2022"
 
 # Revisions
 

fpga/max80.qsf

@@ -126,7 +126,7 @@ set_global_assignment -name CYCLONEIII_CONFIGURATION_DEVICE EPCQ128A
 set_global_assignment -name FORCE_CONFIGURATION_VCCIO ON
 set_global_assignment -name CONFIGURATION_VCCIO_LEVEL 3.3V
 
-set_global_assignment -name RESERVE_ALL_UNUSED_PINS_WEAK_PULLUP "AS OUTPUT DRIVING GROUND"
+set_global_assignment -name RESERVE_ALL_UNUSED_PINS "AS INPUT TRI-STATED WITH WEAK PULL-UP"
 set_global_assignment -name PRE_FLOW_SCRIPT_FILE "quartus_sh:scripts/preflow.tcl"
 set_global_assignment -name POST_MODULE_SCRIPT_FILE "quartus_sh:scripts/postmodule.tcl"
 
@@ -196,7 +196,6 @@ set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to rngio[0]
 set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to rngio[1]
 set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to rngio[2]
 
-
 set_global_assignment -name VERILOG_FILE usb/usb_desc.v
 set_global_assignment -name SYSTEMVERILOG_FILE usb/usb_serial/src_v/usb_cdc_core.sv
 set_global_assignment -name SYSTEMVERILOG_FILE usb/usb_serial/src_v/usbf_device_core.sv

fpga/max80.sdc

@@ -124,4 +124,4 @@ set_multicycle_path -from $fast_mem_we -to $cpu_regs -start -setup 2
 set_multicycle_path -from $fast_mem_we -to $cpu_regs  -start -hold 1
 
 # -------- Random number generator pins are asynchronous --------
-set_false_path -from [get_keepers {*|rng|rngio*}] -to [get_keepers *]
+set_false_path -from [get_ports {rngio[*]}] -to [get_keepers *]

fpga/output/sram.mif

@@ -6,16 +6,16 @@ DATA_RADIX = HEX;
 CONTENT BEGIN
 0000 : 00000000;
 0001 : 00000000;
-0002 : 4631DEFA;
+0002 : DA68A8E8;
 0003 : 00100000;
 0004 : C0102473;
 0005 : 00008137;
-0006 : 2A80006F;
+0006 : 2880006F;
 0007 : 00000000;
 0008 : 0001210B;
 0009 : 008DF413;
 000A : 00040863;
-000B : 3AD000EF;
+000B : 595000EF;
 000C : 408D8DB3;
 000D : 060D8063;
 000E : 00000493;
@@ -48,26 +48,26 @@ CONTENT BEGIN
 0029 : 0000250B;
 002A : 0005B00B;
 002B : 00000000;
-002C : 2850006F;
-002D : 5A80006F;
-002E : 5980006F;
-002F : 31D0006F;
-0030 : 5A80006F;
-0031 : 2710006F;
-0032 : 06D0106F;
-0033 : 2690006F;
-0034 : 2650006F;
-0035 : 2A90006F;
-0036 : 25D0006F;
-0037 : 2590006F;
-0038 : 2550006F;
-0039 : 2510006F;
+002C : 29F0006F;
+002D : 5880006F;
+002E : 5780006F;
+002F : 5050006F;
+0030 : 5880006F;
+0031 : 28B0006F;
+0032 : 2550106F;
+0033 : 2830006F;
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+0035 : 2C30006F;
+0036 : 2770006F;
+0037 : 2730006F;
+0038 : 26F0006F;
+0039 : 26B0006F;
 003A : 00000000;
 003B : 7C5C2D2F;
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+003C : 4101D2A0;
 003D : FFFFFFFF;
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 0042 : 00000000;
@@ -172,1600 +172,1729 @@ CONTENT BEGIN
 00A5 : 00000000;
 00A6 : 00000000;
 00A7 : 00000000;
-00A8 : 00000000;
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-012A : CE9C4D9C;
-012B : CADC49DC;
-012C : CA9C499C;
-012D : C6DC45DC;
-012E : C69C459C;
-012F : C2DC41DC;
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-0134 : 00C50733;
-0135 : 00050693;
-0136 : 0005C783;
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-0178 : FD449EE3;
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-017A : 1908BF37;
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-017D : 41D68733;
-017E : FEEFFCE3;
-017F : 878B57FD;
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-0185 : B72D98E0;
-0186 : 01109463;
-0187 : 99000023;
-0188 : 98100023;
-0189 : 1463B725;
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-018B : 00239870;
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-018F : 98A00023;
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-0191 : 00230069;
-0192 : 00239850;
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-01FB : 0FF30393;
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-01FD : 405505B3;
-01FE : FEB3FCE3;
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-0201 : 400074B7;
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+[0764..1FFF] : 00;
 END;

fpga/output/v1.pin

@@ -103,7 +103,7 @@ GND                          : B15       : gnd    :                   :
 rtc_int_n                    : B16       : input  : 3.3-V LVTTL       :         : 6         : Y              
 flash_io[0]                  : C1        : bidir  : 3.3-V LVTTL       :         : 1         : Y              
 abc_a_oe                     : C2        : output : 3.3-V LVTTL       :         : 1         : Y              
-GND*                         : C3        :        :                   :         : 8         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : C3        :        :                   :         : 8         :                
 VCCIO8                       : C4        : power  :                   : 3.3V    : 8         :                
 GND                          : C5        : gnd    :                   :         :           :                
 sr_dq[14]                    : C6        : bidir  : 3.3-V LVTTL       :         : 8         : Y              
@@ -208,9 +208,9 @@ GND                          : J8        : gnd    :                   :
 GND                          : J9        : gnd    :                   :         :           :                
 GND                          : J10       : gnd    :                   :         :           :                
 GND                          : J11       : gnd    :                   :         :           :                
-GND*                         : J12       :        :                   :         : 5         :                
-GND*                         : J13       :        :                   :         : 5         :                
-GND*                         : J14       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : J12       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : J13       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : J14       :        :                   :         : 5         :                
 hdmi_clk                     : J15       : output : LVDS              :         : 5         : Y              
 hdmi_clk(n)                  : J16       : output : LVDS              :         : 5         : Y              
 abc_a[11]                    : K1        : input  : 3.3-V LVTTL       :         : 2         : Y              
@@ -218,13 +218,13 @@ abc_out_n[4]                 : K2        : input  : 3.3-V LVTTL       :
 VCCIO2                       : K3        : power  :                   : 3.3V    : 2         :                
 GND                          : K4        : gnd    :                   :         :           :                
 abc_out_n[2]                 : K5        : input  : 3.3-V LVTTL       :         : 2         : Y              
-GND*                         : K6        :        :                   :         : 2         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : K6        :        :                   :         : 2         :                
 VCCINT                       : K7        : power  :                   : 1.2V    :           :                
 GND                          : K8        : gnd    :                   :         :           :                
-GND*                         : K9        :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : K9        :        :                   :         : 4         :                
 board_id                     : K10       : input  : 3.3-V LVTTL       :         : 4         : Y              
 VCCINT                       : K11       : power  :                   : 1.2V    :           :                
-GND*                         : K12       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : K12       :        :                   :         : 5         :                
 GND                          : K13       : gnd    :                   :         :           :                
 VCCIO5                       : K14       : power  :                   : 2.5V    : 5         :                
 hdmi_d[0]                    : K15       : output : LVDS              :         : 5         : Y              
@@ -237,14 +237,14 @@ VCCA1                        : L5        : power  :                   : 2.5V
 rngio[0]                     : L6        : bidir  : 3.3-V LVTTL       :         : 2         : Y              
 gpio[0]                      : L7        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
 esp_io0                      : L8        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
-GND*                         : L9        :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L9        :        :                   :         : 4         :                
 abc_xoutpstb_n               : L10       : input  : 3.3-V LVTTL       :         : 4         : Y              
-GND*                         : L11       :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L11       :        :                   :         : 4         :                
 VCCA4                        : L12       : power  :                   : 2.5V    :           :                
-GND*                         : L13       :        :                   :         : 5         :                
-GND*                         : L14       :        :                   :         : 5         :                
-GND*                         : L15       :        :                   :         : 5         :                
-GND*                         : L16       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L13       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L14       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L15       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L16       :        :                   :         : 5         :                
 abc_a[13]                    : M1        : input  : 3.3-V LVTTL       :         : 2         : Y              
 abc_inp_n[1]                 : M2        : input  : 3.3-V LVTTL       :         : 2         : Y              
 VCCIO2                       : M3        : power  :                   : 3.3V    : 2         :                
@@ -253,7 +253,7 @@ GNDA1                        : M5        : gnd    :                   :
 abc_d[1]                     : M6        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
 spi_miso                     : M7        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
 spi_mosi                     : M8        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
-GND*                         : M9        :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : M9        :        :                   :         : 4         :                
 sd_dat[1]                    : M10       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 hdmi_scl                     : M11       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 GNDA4                        : M12       : gnd    :                   :         :           :                
@@ -274,7 +274,7 @@ GND                          : N10       : gnd    :                   :
 exth_hg                      : N11       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 exth_ha                      : N12       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 VCCD_PLL4                    : N13       : power  :                   : 1.2V    :           :                
-GND*                         : N14       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : N14       :        :                   :         : 5         :                
 hdmi_d[1]                    : N15       : output : LVDS              :         : 5         : Y              
 hdmi_d[1](n)                 : N16       : output : LVDS              :         : 5         : Y              
 abc_xmemw800_n               : P1        : input  : 3.3-V LVTTL       :         : 2         : Y              
@@ -291,7 +291,7 @@ rngio[1]                     : P11       : bidir  : 3.3-V LVTTL       :
 GND                          : P12       : gnd    :                   :         :           :                
 VCCIO4                       : P13       : power  :                   : 3.3V    : 4         :                
 tty_dtr                      : P14       : input  : 3.3-V LVTTL       :         : 4         : Y              
-GND*                         : P15       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : P15       :        :                   :         : 5         :                
 hdmi_d[2](n)                 : P16       : output : LVDS              :         : 5         : Y              
 abc_xmemw80_n                : R1        : input  : 3.3-V LVTTL       :         : 2         : Y              
 GND                          : R2        : gnd    :                   :         :           :                

fpga/output/v2.pin

@@ -103,7 +103,7 @@ GND                          : B15       : gnd    :                   :
 rtc_int_n                    : B16       : input  : 3.3-V LVTTL       :         : 6         : Y              
 flash_io[0]                  : C1        : bidir  : 3.3-V LVTTL       :         : 1         : Y              
 abc_host                     : C2        : output : 3.3-V LVTTL       :         : 1         : Y              
-GND*                         : C3        :        :                   :         : 8         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : C3        :        :                   :         : 8         :                
 VCCIO8                       : C4        : power  :                   : 3.3V    : 8         :                
 GND                          : C5        : gnd    :                   :         :           :                
 sr_dq[14]                    : C6        : bidir  : 3.3-V LVTTL       :         : 8         : Y              
@@ -208,9 +208,9 @@ GND                          : J8        : gnd    :                   :
 GND                          : J9        : gnd    :                   :         :           :                
 GND                          : J10       : gnd    :                   :         :           :                
 GND                          : J11       : gnd    :                   :         :           :                
-GND*                         : J12       :        :                   :         : 5         :                
-GND*                         : J13       :        :                   :         : 5         :                
-GND*                         : J14       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : J12       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : J13       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : J14       :        :                   :         : 5         :                
 hdmi_clk                     : J15       : output : LVDS              :         : 5         : Y              
 hdmi_clk(n)                  : J16       : output : LVDS              :         : 5         : Y              
 abc_a[11]                    : K1        : bidir  : 3.3-V LVTTL       :         : 2         : Y              
@@ -218,13 +218,13 @@ abc_out_n[4]                 : K2        : bidir  : 3.3-V LVTTL       :
 VCCIO2                       : K3        : power  :                   : 3.3V    : 2         :                
 GND                          : K4        : gnd    :                   :         :           :                
 abc_out_n[2]                 : K5        : bidir  : 3.3-V LVTTL       :         : 2         : Y              
-GND*                         : K6        :        :                   :         : 2         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : K6        :        :                   :         : 2         :                
 VCCINT                       : K7        : power  :                   : 1.2V    :           :                
 GND                          : K8        : gnd    :                   :         :           :                
-GND*                         : K9        :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : K9        :        :                   :         : 4         :                
 board_id                     : K10       : input  : 3.3-V LVTTL       :         : 4         : Y              
 VCCINT                       : K11       : power  :                   : 1.2V    :           :                
-GND*                         : K12       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : K12       :        :                   :         : 5         :                
 GND                          : K13       : gnd    :                   :         :           :                
 VCCIO5                       : K14       : power  :                   : 2.5V    : 5         :                
 hdmi_d[0]                    : K15       : output : LVDS              :         : 5         : Y              
@@ -237,14 +237,14 @@ VCCA1                        : L5        : power  :                   : 2.5V
 rngio[0]                     : L6        : bidir  : 3.3-V LVTTL       :         : 2         : Y              
 gpio[0]                      : L7        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
 esp_io0                      : L8        : bidir  : 3.3-V LVTTL       :         : 3         : Y              
-GND*                         : L9        :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L9        :        :                   :         : 4         :                
 abc_xoutpstb_n               : L10       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
-GND*                         : L11       :        :                   :         : 4         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : L11       :        :                   :         : 4         :                
 VCCA4                        : L12       : power  :                   : 2.5V    :           :                
-usb_rx(n)                    : L13       : input  : LVDS              :         : 5         : Y              
-GND*                         : L14       :        :                   :         : 5         :                
+usb_rx(n)                    : L13       : input  : Bus LVDS          :         : 5         : Y              
+RESERVED_INPUT_WITH_WEAK_PULLUP : L14       :        :                   :         : 5         :                
 sd_cd_n                      : L15       : input  : 2.5 V             :         : 5         : Y              
-usb_rx                       : L16       : input  : LVDS              :         : 5         : Y              
+usb_rx                       : L16       : input  : Bus LVDS          :         : 5         : Y              
 GND+                         : M1        :        :                   :         : 2         :                
 GND+                         : M2        :        :                   :         : 2         :                
 VCCIO2                       : M3        : power  :                   : 3.3V    : 2         :                
@@ -274,7 +274,7 @@ GND                          : N10       : gnd    :                   :
 exth_hg                      : N11       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 exth_ha                      : N12       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 VCCD_PLL4                    : N13       : power  :                   : 1.2V    :           :                
-GND*                         : N14       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : N14       :        :                   :         : 5         :                
 hdmi_d[1]                    : N15       : output : LVDS              :         : 5         : Y              
 hdmi_d[1](n)                 : N16       : output : LVDS              :         : 5         : Y              
 abc_xmemw800_n               : P1        : bidir  : 3.3-V LVTTL       :         : 2         : Y              
@@ -291,7 +291,7 @@ rngio[1]                     : P11       : bidir  : 3.3-V LVTTL       :
 GND                          : P12       : gnd    :                   :         :           :                
 VCCIO4                       : P13       : power  :                   : 3.3V    : 4         :                
 led[1]                       : P14       : output : 3.3-V LVTTL       :         : 4         : Y              
-GND*                         : P15       :        :                   :         : 5         :                
+RESERVED_INPUT_WITH_WEAK_PULLUP : P15       :        :                   :         : 5         :                
 hdmi_d[2](n)                 : P16       : output : LVDS              :         : 5         : Y              
 abc_xmemw80_n                : R1        : bidir  : 3.3-V LVTTL       :         : 2         : Y              
 GND                          : R2        : gnd    :                   :         :           :                
@@ -306,7 +306,7 @@ gpio[3]                      : R10       : bidir  : 3.3-V LVTTL       :
 exth_hd                      : R11       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 exth_he                      : R12       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 hdmi_sda                     : R13       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
-led[2]                       : R14       : output : 3.3-V LVTTL       :         : 4         : Y              
+led[0]                       : R14       : output : 3.3-V LVTTL       :         : 4         : Y              
 GND                          : R15       : gnd    :                   :         :           :                
 hdmi_d[2]                    : R16       : output : LVDS              :         : 5         : Y              
 VCCIO3                       : T1        : power  :                   : 3.3V    : 3         :                
@@ -321,7 +321,7 @@ exth_hc                      : T9        : input  : 3.3-V LVTTL       :
 abc_a[1]                     : T10       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 exth_hf                      : T11       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 abc_xinpstb_n                : T12       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
-led[0]                       : T13       : output : 3.3-V LVTTL       :         : 4         : Y              
+led[2]                       : T13       : output : 3.3-V LVTTL       :         : 4         : Y              
 abc_a[13]                    : T14       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 hdmi_hpd                     : T15       : bidir  : 3.3-V LVTTL       :         : 4         : Y              
 VCCIO4                       : T16       : power  :                   : 3.3V    : 4         :                

fpga/spirom.sv

@@ -131,23 +131,22 @@ module spirom (
    //
    // FIFO and input latches
    //
-   reg [0:0]		  spi_in_q;
-   reg			  spi_in_req;
-   reg			  spi_in_req_q;
+   reg [1:0]		  spi_in_q;
+   reg			  spi_ram_in_req;
    wire [11:0]		  wrusedw;
    wire [8:0]		  rdusedw;
    wire [15:0]		  fifo_out;
-   wire [1:0] 		  spi_in_data;
+   wire [1:0]		  spi_in_data;
 
-   assign spi_in_data[0] = spi_dual ? spi_in_q[0]   : spi_in_shr[0];
-   assign spi_in_data[1] = spi_dual ? spi_in_shr[0] : spi_in_shr[1];
+   assign spi_in_data[0] = spi_dual ? spi_in_q[0] : spi_in_q[1];
+   assign spi_in_data[1] = spi_dual ? spi_in_q[1] : spi_in_shr[0];
 
    ddufifo spirom_fifo (
 			.aclr ( ~rst_n ),
 
 			.wrclk ( rom_clk ),
 			.data ( spi_in_data ),
-			.wrreq ( spi_in_req_q & is_spi ),
+			.wrreq ( spi_ram_in_req ),
 			.wrusedw ( wrusedw ),
 
 			.rdclk ( ram_clk ),
@@ -231,14 +230,21 @@ module spirom (
    // Negative indicies refer to fractional bytes
    reg [2:-3]  spi_cmd_ctr;
    reg [23:-3] spi_data_ctr;
-   reg	       spi_clk_en = 1'b0;
+   reg	       spi_clk_en;
+   reg [1:0]   spi_clk_en_q;
    reg	       spi_mosi_en;
    reg [1:0]   go_spi_q;
    wire        go_spi_s;
    reg	       spi_more_q;
    reg	       spi_active;
-   reg [3:0]   spi_cs_ctr;
+   reg	       spi_active_q;
    reg [31:0]  spi_out_shr;
+   reg	       spi_in_req;
+   reg	       spi_in_req_q;
+
+   localparam spi_cs_wait_lg2 = 0; // 8 bit times between CS# and first clock
+   reg [spi_cs_wait_lg2:0]   spi_cs_ctr;
+   wire			     spi_cs_ready = spi_cs_ctr[spi_cs_wait_lg2];
 
    // Explicit synchronizers for handshake signals
    synchronizer #(.width(1)) go_spi_synchro
@@ -264,34 +270,47 @@ module spirom (
        begin
 	  spi_cmd_ctr  <= 6'b0;
 	  spi_clk_en   <= 1'b0;
-	  spi_clk_en_q <= 1'b0;
+	  spi_clk_en_q <= 'b0;
 	  spi_data_ctr <= 27'b0;
 	  spi_cs_n     <= 1'b1;
 	  spi_cs_ctr   <= 'b0;
 	  spi_in_req   <= 1'b0;
 	  spi_in_req_q <= 1'b0;
+	  spi_ram_in_req <= 1'b0;
 	  spi_mosi_en  <= 1'b1;
-	  spi_in_q     <= 1'b0;
 	  spi_in_shr   <= 32'b0;
 	  spi_active   <= 1'b0;
+	  spi_active_q <= 1'b0;
 	  spi_more_q   <= 1'b0;
 	  spi_out_shr  <= 32'b0;
        end
      else
        begin
-	  spi_in_req   <= 1'b0;
-	  spi_in_req_q <= spi_in_req;
-	  spi_clk_en   <= 1'b0;
-	  spi_clk_en_q <= spi_clk_en;
+	  // Fun with long pipelined chains of registers...
+	  spi_in_req     <= 1'b0;
+	  spi_in_req_q   <= spi_in_req;
+	  spi_ram_in_req <= spi_in_req_q & is_ram;
+
+	  spi_clk_en     <= 1'b0;
+	  spi_clk_en_q   <= (spi_clk_en_q << 1'b1) | spi_clk_en;
+
+	  spi_active_q   <= spi_active;
+
+	  if ( spi_clk_en_q[1] )
+	    spi_in_shr <= { spi_in_shr[30:0], spi_in_q[1] };
 
 	  // Bit to start transmitting on the next clock down transition
-	  spi_out_shr <= spi_out_shr << spi_clk_en;
+	  // This needs to be delayed by one cycle in order to match
+	  // the one-cycle delay imposed by the DDR output buffer
+	  // when spi_clk_en goes high.
+	  if ( spi_clk_en_q )
+	    spi_out_shr <= { spi_out_shr[30:0], 1'b1 };
 
-	  // After asserting CS#, wait 16 SPI clock times
+	  // After asserting CS#, wait 8 SPI clock times
 	  if (spi_cs_n)
 	    spi_cs_ctr <= 'b0;
 	  else
-	    spi_cs_ctr <= spi_cs_ctr + ~&spi_cs_ctr;
+	    spi_cs_ctr <= spi_cs_ctr + !spi_cs_ready;
 
 	  // Note: datalen <- spi_data_ctr is a 2-cycle multipath
 	  if (go_spi_s & ~spi_active)
@@ -314,55 +333,56 @@ module spirom (
 	    end
 	  else
 	    begin
-	       spi_active   <= &spi_cs_ctr;
+	       spi_active   <= 1'b1;
 	       spi_cs_n     <= 1'b0;
 
-	       if ( spi_active )
+	       if ( spi_active & spi_cs_ready )
 		 begin
 		    // This will block unnecessarily if the DMA queue
 		    // is full from a previous transaction, but that doesn't
 		    // matter in practice... just let it drain.
 		    spi_clk_en <= dma_queue_space;
+		    spi_mosi_en <= ~spi_dual | |spi_cmd_ctr;
 
-		    if ( spi_clk_en )
-		      begin
-			 // Note: spi_in_shr[0] and spi_in_q[1] should
-			 // be merged into a single register.
-			 spi_in_shr   <= { spi_in_shr[30:0], spi_io[1] };
-			 spi_in_q[0]  <= spi_io[0];
-
-			 if ( spi_cmd_ctr == 6'd1 )
-			   spi_mosi_en  <= ~spi_dual;
-
-			 if ( ~|spi_cmd_ctr )
-			   begin
-			      spi_in_req <= spi_data_ctr[-3] | spi_dual;
-			      spi_data_ctr <= spi_data_ctr - (1'b1 << spi_dual);
-			   end
-			 else
-			   begin
-			      spi_cmd_ctr <= spi_cmd_ctr - 1'b1;
-			   end
-		      end // if ( spi_clk_en )
-		 end // if ( ~spi_cs_n )
-	    end // else: !if( ~|spi_data_ctr )
+		    if ( spi_clk_en & ~|spi_cmd_ctr )
+		      spi_in_req <= spi_data_ctr[-3] | spi_dual;
+		 end // if ( spi_active & spi_cs_ready )
+
+	       if ( (spi_active & ~spi_active_q) | spi_clk_en )
+		 begin
+		    // This is either the kickoff cycle or advancing
+		    if ( ~|spi_cmd_ctr )
+		      spi_data_ctr <= spi_data_ctr - (1'b1 << spi_dual);
+		    else
+		      spi_cmd_ctr <= spi_cmd_ctr - 1'b1;
+		 end // if ( spi_clk_en )
+	    end // else: !if( ~|{spi_data_ctr, spi_cmd_ctr} )
        end // else: !if(~rst_n)
 
-   // SPI output data is shifted on the negative edge
-   reg 	       spi_out_q;
+   //
+   // Input I/O: latch on the positive spi_clk, which is the
+   // negative rom_clk.
+   //
    always @(negedge rom_clk)
-     spi_out_q <= spi_out_shr[31];
+     spi_in_q <= spi_io;
 
-   assign spi_io[0] = spi_mosi_en ? spi_out_q : 1'bz;
+   //
+   // Output I/O: changed on the negative spi_clk, which is the
+   // positive rom_clk (thus matching when these registers are set.)
+   //
+   assign spi_io[0] = spi_mosi_en ? spi_out_shr[31] : 1'bz;
    assign spi_io[1] = 1'bz;
 
    //
-   // SPI_SCK output buffer: emit a clock pulse iff spi_clk_en_q is high
+   // SPI_SCK output buffer: emit a spi_clk clock pulse if spi_clk_en
+   // is high; note that this is phase-inverted versus the internal
+   // rom_clk, and that this is sampled one full rom_clk before
+   // output, so
    //
    ddio_out spi_clk_buf (
 			 .aclr ( ~rst_n ),
-			 .datain_h ( spi_clk_en_q ),
-			 .datain_l ( 1'b0 ),
+			 .datain_h ( 1'b0 ),
+			 .datain_l ( spi_clk_en ),
 			 .outclock ( rom_clk ),
 			 .dataout ( spi_sck )
 			 );

fpga/v2.qsf

@@ -9,17 +9,17 @@ set_global_assignment -name SYSTEMVERILOG_FILE v2.sv
 
 set_global_assignment -name SOURCE_TCL_SCRIPT_FILE max80.qsf
 
-set_instance_assignment -name IO_STANDARD "Bus LVDS" -to usb_rx
+set_instance_assignment -name IO_STANDARD "BUS LVDS" -to usb_rx
 set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to usb_rx
-set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to "usb_rx(n)"
-set_instance_assignment -name WEAK_PULL_UP_RESISTOR ON -to usb_dp
-set_instance_assignment -name WEAK_PULL_UP_RESISTOR ON -to usb_dn
+set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to usb_dp
+set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to usb_dn
+set_instance_assignment -name WEAK_PULL_UP_RESISTOR OFF -to usb_pu
 
 set_instance_assignment -name TERMINATION OFF -to usb_rx
-set_instance_assignment -name TERMINATION OFF -to "usb_rx(n)"
 
 set_instance_assignment -name IO_STANDARD "2.5 V" -to sd_cd_n
 set_instance_assignment -name WEAK_PULL_UP_RESISTOR ON -to sd_cd_n
 
 # Quartus insists on this line...
+
 set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top

rv32/Makefile

@@ -82,7 +82,7 @@ dram.bin: max80.elf
 checksum.h: dram.bin boot.bin checksum.pl
 	$(PERL) checksum.pl -o $@ -p boot.bin \
 		-l $$(($$($(NM) -n max80.elf --radix=decimal | \
-			grep ' R __dram_init_end$$' | \
+			grep ' [A-Z] __dram_init_end$$' | \
 	                awk '{ print $$1; }') - (1 << 30))) \
 		dram.bin
 

rv32/checksum.h

@@ -1,4 +1,4 @@
 #ifndef CHECKSUM_H
 #define CHECKSUM_H
-#define SDRAM_SUM 0x4631defa
+#define SDRAM_SUM 0xda68a8e8
 #endif

rv32/console.h

@@ -76,4 +76,6 @@ static __always_inline void con_flush(void)
 	pause();
 }
 
+void con_print_hex(unsigned int); /* For pre-SDRAM capable code */
+
 #endif /* CONSOLE_H */

rv32/romcopy.c

@@ -43,8 +43,6 @@ enum romcmd {
     ROM_FAST_READ_DUAL			= 0x3b
 };
 
-size_t __sbss romcopy_log[15];
-
 #define SPIROM_DUAL_MODE 1
 
 void __hot romcopy_download(void *dst, size_t offset, size_t len)
@@ -58,7 +56,7 @@ void __hot romcopy_download(void *dst, size_t offset, size_t len)
     } else {
 	cmd = ROM_FAST_READ;
     }
-  
+
     ROMCOPY_RAMADDR = (size_t)dst;
     ROMCOPY_ROMCMD  = __rom_offset + offset + (cmd << 24);
     ROMCOPY_DATALEN = len | flags;
@@ -71,7 +69,39 @@ void __hot romcopy_bzero(void *dst, size_t len)
     ROMCOPY_DATALEN = len | ROMCOPY_ZERO_BUFFER | ROMCOPY_WRITE_RAM;
 }
 
-uint32_t __sbss romcopy_time[2];
+static __hot void romcopy_config_flash(void)
+{
+    /* Enable writing volatile status register bits */
+    ROMCOPY_ROMCMD = ROM_VOLATILE_SR_WRITE_ENABLE << 24;
+    ROMCOPY_DATALEN = ROMCOPY_SPI_CMDLEN(1);
+    waitfor(ROMCOPY_IRQ);
+
+    /* Write SR3 = 0; this sets the drive strength to maximum */
+    ROMCOPY_ROMCMD = ROM_WRITE_SR3 << 24;
+    ROMCOPY_DATALEN = ROMCOPY_SPI_CMDLEN(2);
+    waitfor(ROMCOPY_IRQ);
+
+    asm volatile("nop; nop");	/* Make extra sure tSHSL2 is OK */
+
+    if ( 1 ) {
+	con_puts(hotstr("ROM serial: "));
+
+	ROMCOPY_ROMCMD  = ROM_READ_UNIQUE_ID << 24;
+	ROMCOPY_DATALEN = ROMCOPY_SPI_CMDLEN(5) | ROMCOPY_SPI_MORE;
+	waitfor(ROMCOPY_IRQ);
+
+	ROMCOPY_DATALEN = ROMCOPY_SPI_CMDLEN(4) | ROMCOPY_SPI_MORE;
+	waitfor(ROMCOPY_IRQ);
+
+	con_print_hex(ROMCOPY_INPUT);
+	ROMCOPY_DATALEN = ROMCOPY_SPI_CMDLEN(4);
+	waitfor(ROMCOPY_IRQ);
+
+	con_print_hex(ROMCOPY_INPUT);
+	con_putc('\n');
+    }
+}
+
 IRQHANDLER(romcopy,0)
 {
     static __sbss unsigned int romcopy_state;
@@ -79,6 +109,8 @@ IRQHANDLER(romcopy,0)
 
     switch (romcopy_state++) {
     case 0:
+	romcopy_config_flash();
+
 	/* Copy DRAM data */
 	len = __dram_init_end - __dram_init_start;
 	romcopy_download(__dram_init_start, 0, len);
@@ -99,9 +131,9 @@ IRQHANDLER(romcopy,0)
  * number to 12 characters in base36 (technically a wraparound that is
  * never going to matter.) It's more fun than plain hex... :)
  */
-char serial_str[16];
+char __bss_hot serial_str[16];
 
-uint64_t rom_get_serial(void)
+uint64_t __hot rom_get_serial(void)
 {
     union {
 	uint32_t l[2];
@@ -135,8 +167,7 @@ uint64_t rom_get_serial(void)
 	usbdesc_rom[2+2*i] = c;
     }
 
-    if ( 1 )
-	con_printf("ROM serial: %08x-%08x (%s)\n", o.l[1], o.l[0], serial_str);
+    con_printf("ROM serial: %08x-%08x (%s)\n", o.l[1], o.l[0], serial_str);
 
     return o.q;
 }

rv32/system.c

@@ -9,7 +9,7 @@
 #define MINITESTS 1
 #define DELAY     1
 
-static void __hot con_print_hex(unsigned int n)
+void __hot con_print_hex(unsigned int n)
 {
     for (int i = 0; i < 8; i++) {
 	unsigned int c = n >> 28;
@@ -82,6 +82,9 @@ IRQHANDLER(sysclock,0)
 
 static void late_init(void);
 
+static const volatile __dram_data
+uint32_t test_data[2] = { 0x01234567, 0x89abcdef };
+
 uint32_t __sbss timer_irq_start;
 void __hot init(void)
 {
@@ -149,6 +152,12 @@ void __hot init(void)
 	con_putc(' ');
 	con_print_hex(~not_zero);
 	con_putc('\n');
+
+	con_puts(hotstr("Test data: "));
+	con_print_hex(test_data[0]);
+	con_putc(' ');
+	con_print_hex(test_data[1]);
+	con_putc('\n');
 	
 	if (wrerr)
 	    con_puts(hotstr("SDRAM read/write error\n"));

rv32/test/main.c

@@ -229,11 +229,6 @@ void main(void)
     while (!(irqmask() & (1 << ROMCOPY_IRQ)))
 	pause();
 
-    con_printf("SDRAM download took %u us\n",
-	       romcopy_time[0]/(CPU_HZ/1000000));
-    con_printf("SDRAM bss clear took %u us\n",
-	       romcopy_time[1]/(CPU_HZ/1000000));
-
     test_download();
 
     sdcard_reset();