tty: add status register and irq support; clean up iodev map

Add a status register to the tty to avoid FIFO overflow and be able to
determine when the transmitter is truly empty. Add support for the
status bits to generate interrupts.

fpga/max80.sv

@@ -160,7 +160,7 @@ module max80 (
        end
      else
        begin
-	  reset_cmd_q <= reset_cmd_q | (rst_n & reset_cmd);
+	  reset_cmd_q <= rst_n & (reset_cmd_q | reset_cmd);
 	  if (~rst_n)
 	    { rst_n, rst_ctr } <= rst_ctr + 1'b1;
        end
@@ -386,8 +386,22 @@ module max80 (
 
    // Decode for small devices; use address space within range of
    // negative offsets from the zero register [-1K,0)
+   //
+   // Device map:
+   //  0 - LED
+   //  1 - Reset
+   //  2 - SPI->SDRAM downloader
+   //  3 - Serial port
+   //
+   // A device has IRQ (devno)+16 if it needs an interrupt.
+   //
+
    wire [15:0] iodev = cpu_mem_quad[3] << cpu_mem_addr[9:6];
+   tri0 [15:0] iodev_irq;	// tri0: if nothing is driving, value is 0
 
+   //
+   // SDRAM
+   //
    wire [31:0] sdram_rd;
    wire        sdram_rack;
    wire        sdram_rready;
@@ -489,6 +503,7 @@ module max80 (
 	      .REGS_INIT_ZERO ( 1 ),
 	      .STACKADDR ( 32'h4 << cpu_fast_mem_bits )
 	      )
+
    cpu (
 	.clk ( sys_clk ),
 	.resetn ( rst_n ),
@@ -508,7 +523,7 @@ module max80 (
 	.mem_la_addr  ( cpu_la_addr ),
 	.mem_la_wstrb ( cpu_la_wstrb ),
 
-	.irq ( 0 ),
+	.irq ( { iodev_irq, 16'b0 } ),
 	.eoi ( )
 	);
 
@@ -572,7 +587,7 @@ module max80 (
      endcase
 
    // Hard system reset under program control
-   assign reset_cmd = rst_n & iodev[15] & cpu_mem_wstrb[0] & cpu_mem_wdata[0];
+   assign reset_cmd = rst_n & iodev[1] & cpu_mem_wstrb[0] & cpu_mem_wdata[0];
 
    // LED indication from the CPU
    reg [2:0]   led_q;
@@ -627,16 +642,19 @@ module max80 (
    wire        tty_data_in;	// Input data
    wire        tty_cts_out;	// Assert CTS# externally
    wire        tty_rts_in;	// RTS# received from outside
+   wire [31:0] tty_rdata;
 
    assign tty_cts_out  = 1'b0;	// Assert CTS#
    tty tty (
 	    .rst_n ( rst_n ),
 	    .clk ( sys_clk ),
 
-	    .valid ( iodev[1] ),
+	    .valid ( iodev[3] ),
 	    .wstrb ( cpu_mem_wstrb ),
 	    .wdata ( cpu_mem_wdata ),
-	    .addr ( cpu_mem_addr[2] ),
+	    .rdata ( tty_rdata ),
+	    .addr ( cpu_mem_addr[3:2] ),
+	    .irq  ( iodev_irq[3] ),
 
 	    .tty_txd ( tty_data_out ) // DTE -> DCE
 	    );
@@ -670,7 +688,9 @@ module max80 (
    //
    always @(*)
      case ( cpu_mem_addr[9:6] )
+       4'h0:    iodev_rdata = { 29'b0, led_q };
        4'h2:    iodev_rdata = { 31'b0, rom_done_q };
+       4'h3:	iodev_rdata = tty_rdata;
        default: iodev_rdata = 32'hffff_ffff;
      endcase
    

fpga/output_files/max80.map

@@ -11,7 +11,7 @@ Quad-Serial configuration device dummy clock cycle: 8
 
 Notes:
 
-- Data checksum for this conversion is 0xF3795A1E
+- Data checksum for this conversion is 0xF385C8C0
 
 - All the addresses in this file are byte addresses
 

fpga/tty.sv

@@ -5,20 +5,30 @@
 // Currently only transmit is supported, 8-N-1, at a fixed speed.
 // The baud rate is tty_clk/((divisor+1)*16).
 //
-// Currently there is no overrun checking or interrupt support, but that
+// The registers are as follows:
-// can come later. A large FIFO makes that less of an issue anyway...
 //
+// 0 - WO - data register (will be RW)
+// 1 - RW - baud rate register (binary fraction of TTY_CLK/16 - 1)
+// 2 - RO - status register
+//          0 - transmitter idle (FIFO and shift register empty)
+//          1 - transmit FIFO 3/4 empty
+//	    2 - transmit FIFO 1/2 empty
+//          3 - transmit FIFO 1/2 full (inverse of bit 2)
+//          4 - transmit FIFO 3/4 full
+// 3 - RW - interrupt enable register (status register mask)
 
 module tty (
-	    input 	 rst_n,
+	    input 	      rst_n,
-	    input 	 clk,
+	    input 	      clk,
 
-	    input 	 valid,
+	    input 	      valid,
-	    input [3:0]  wstrb,
+	    input [3:0]       wstrb,
-	    input [31:0] wdata,
+	    input [31:0]      wdata,
-	    input [0:0]  addr,
+	    input [1:0]       addr,
+	    output reg [31:0] rdata,
+	    output reg	      irq,
 
-	    output 	 tty_txd
+	    output 	      tty_txd
 	    );
 
    `include "functions.sv"	// For ModelSim
@@ -53,6 +63,7 @@ module tty (
    wire tx_wrreq;
    wire tx_rdempty;
    wire [7:0] tx_data;
+   wire [8:0] tx_usedw;
    
    fifo txfifo (
 		.aclr ( ~rst_n ),
@@ -64,30 +75,9 @@ module tty (
 		.empty ( tx_rdempty ),
 		.full ( ),
 		.q ( tx_data ),
-		.usedw ( )
+		.usedw ( tx_usedw )
 		);
 
-   //
-   // CPU -> transmitter data. No wait state is needed nor expected.
-   //
-
-   // Data mask (if/when needed)
-   wire [31:0] wmask = {{8{wstrb[3]}}, {8{wstrb[2]}},
-			{8{wstrb[1]}}, {8{wstrb[0]}}};
-
-   // Data (FIFO) register; normally addressed as byte
-   // Protect against long pulses (edge detect)
-   reg old_wstrb;
-   always @(posedge clk)
-     old_wstrb <= wstrb[0];
-
-   assign tx_wrreq = valid & wstrb[0] & ~old_wstrb & (addr == 0);
-
-   // Divisor register
-   always @(posedge clk)
-     if (wstrb[0] & valid & (addr == 1))
-       divisor <= wdata[NCO_BITS-1:0] & wmask;
-
    //
    // Transmitter
    //
@@ -135,4 +125,63 @@ module tty (
 		 end // if (tx_phase == 4'hF)
 	    end // if ( tty_clk_en )
        end // else: !if(~rst_n)
+
+   //
+   // CPU interface
+   //
+
+   // Data (FIFO) register; normally addressed as byte
+   // Protect against long pulses (edge detect)
+   reg old_wstrb;
+   always @(posedge clk)
+     old_wstrb <= wstrb[0];
+
+   assign tx_wrreq = valid & wstrb[0] & ~old_wstrb & (addr == 2'b00);
+
+   // Status register definition
+   localparam status_bits = 5;
+   
+   wire [status_bits-1:0] status;
+
+   assign status[0] = tx_rdempty & (tx_bits == 4'd0);
+   assign status[1] = tx_usedw[8:7] == 2'b00;
+   assign status[2] = ~tx_usedw[8];
+   assign status[3] = tx_usedw[8];
+   assign status[4] = tx_usedw[8:7] == 2'b11;
+   
+   reg [status_bits-1:0]   irq_en;
+
+   //
+   // Control register writes.
+   // Only full word writes are supported.
+   //
+   always @(negedge rst_n or posedge clk)
+     if (~rst_n)
+       begin
+	  irq_en <= 5'b0;
+       end
+     else if (valid & (&wstrb))
+       case (addr)
+	 2'b01: divisor <= wdata[NCO_BITS-1:0];
+	 2'b11: irq_en  <= wdata[status_bits-1:0];
+       endcase // case (addr)
+
+   // Read MUX
+   always @(*)
+     begin
+	rdata = 32'b0;
+	case (addr)
+	  2'b01: rdata = divisor;
+	  2'b10: rdata = status;
+	  2'b11: rdata = irq_en;
+	endcase // case (addr)
+     end
+
+   // Interrupt
+   always @(negedge rst_n or posedge clk)
+     if (~rst_n)
+       irq <= 1'b0;
+     else
+       irq <= |(status & irq_en);
+   
 endmodule // tty

fw/boot.mif

@@ -5,7 +5,7 @@ ADDRESS_RADIX = HEX;
 DATA_RADIX = HEX;
 CONTENT BEGIN
 000 : 00002137;
-001 : 3300006F;
+001 : 31A0006F;
 002 : 00000000;
 003 : 00000000;
 004 : C0067139;
@@ -18,7 +18,7 @@ CONTENT BEGIN
 00B : DC42DA3E;
 00C : 850BDE46;
 00D : 00EF0000;
-00E : 408237A0;
+00E : 40823680;
 00F : 43224292;
 010 : 4E4243B2;
 011 : 4F624ED2;
@@ -36,25 +36,25 @@ CONTENT BEGIN
 01D : D05AD256;
 01E : CC62CE5E;
 01F : C86ACA66;
-020 : 2645C66E;
+020 : 2679C66E;
 021 : C0000023;
 022 : C8002783;
 023 : 2473DFF5;
 024 : 6085C010;
-025 : 02008513;
+025 : 15008513;
-026 : 83132E75;
+026 : 83132E5D;
 027 : 25838601;
 028 : 63850003;
-029 : F2C38513;
+029 : 05C38513;
 02A : 00158713;
 02B : 00E32023;
-02C : 05932EE9;
+02C : 05932ED1;
 02D : 55B30540;
 02E : 648502B4;
-02F : F4048513;
+02F : 07048513;
 030 : 40000D37;
 031 : 40080A37;
-032 : 660526C9;
+032 : 66052E75;
 033 : 89ABD6B7;
 034 : 1D951837;
 035 : 11160C93;
@@ -72,1055 +72,1131 @@ CONTENT BEGIN
 041 : FF4D10E3;
 042 : 06376D85;
 043 : 85130002;
-044 : 2EA5F5CD;
+044 : 2E8D08CD;
-045 : 000A4E37;
+045 : 40000437;
-046 : 40000437;
+046 : 69C16A05;
-047 : 09136A85;
+047 : 40080937;
-048 : 6A410FFE;
+048 : 0A9384A2;
-049 : 400809B7;
+049 : 8E260204;
-04A : 0B1384A2;
+04A : 0004D583;
-04B : 8EA60204;
+04B : 002E5603;
-04C : 0004D583;
+04C : 05130491;
-04D : 002ED603;
+04D : 26B90A0A;
-04E : 85130491;
+04E : FF5497E3;
-04F : 26B1F70A;
+04F : 944E4529;
-050 : FF6497E3;
+050 : 1FE32CC5;
-051 : 2CF54529;
+051 : 2B73FD24;
-052 : C0102F73;
+052 : 8E93C010;
-053 : C0102FF3;
+053 : A6838641;
-054 : 41EF8533;
+054 : 6F05000E;
-055 : FEA97CE3;
+055 : 42000637;
-056 : 17E39452;
+056 : 400005B7;
-057 : 2B73FD34;
+057 : 0ACF0513;
-058 : 8793C010;
+058 : 05132615;
-059 : 43948641;
+059 : 47A102D0;
-05A : 06376085;
+05A : 45C12337;
-05B : 05B74200;
+05B : 78DAD737;
-05C : 85134000;
+05C : 020005B7;
-05D : 2E11F7C0;
+05D : 00800637;
-05E : 02D00313;
+05E : 86418493;
-05F : 25B743A1;
+05F : 86A186A3;
-060 : D63745C1;
+060 : 86F1AA23;
-061 : 08B778DA;
+061 : 49814A85;
-062 : 0D370200;
+062 : 86D18913;
-063 : 84930080;
+063 : 87418A13;
-064 : 86238641;
+064 : 40000EB7;
-065 : AA238661;
+065 : 0B935CFD;
-066 : 4A858671;
+066 : 0C13BA13;
-067 : 89134981;
+067 : 8D93ECB7;
-068 : 8A1386C1;
+068 : 0D13FFF5;
-069 : 0FB78741;
+069 : 84330016;
-06A : 5CFD4000;
+06A : 458101D9;
-06B : BA158B93;
+06B : 20238522;
-06C : ECB60C13;
+06C : 2C110004;
-06D : FFF88D93;
+06D : 852255FD;
-06E : 84330D05;
+06E : 01942023;
-06F : 458101F9;
+06F : C5932429;
-070 : 20238522;
+070 : C00CFFF9;
-071 : 2C090004;
+071 : 24018522;
-072 : 852255FD;
+072 : 852285CE;
-073 : 01942023;
+073 : 01342023;
-074 : C5932421;
+074 : 86B32ADD;
-075 : C00CFFF9;
+075 : 85220379;
-076 : 2AFD8522;
+076 : 018685B3;
-077 : 852285CE;
+077 : 22E5C00C;
-078 : 01342023;
+078 : 00040837;
-079 : 86B32AD5;
+079 : FFF80893;
-07A : 85220379;
+07A : 011AFE33;
-07B : 018685B3;
+07B : 40000EB7;
-07C : 22DDC00C;
+07C : 02D00F13;
-07D : 00040E37;
+07D : 000E1863;
-07E : FFFE0E93;
+07E : 00094083;
-07F : 01DAFF33;
+07F : CC100023;
-080 : 40000FB7;
+080 : 01E90023;
-081 : 02D00513;
+081 : 0004AF83;
-082 : 000F1863;
+082 : 99FE0A85;
-083 : 00094783;
+083 : 01B9F9B3;
-084 : C4F00023;
+084 : F9AA9BE3;
-085 : 00A90023;
+085 : 05136505;
-086 : 0004A083;
+086 : 2C150E45;
-087 : 99860A85;
+087 : 78DADCB7;
-088 : 01B9F9B3;
+088 : 27B742A1;
-089 : F9AA9BE3;
+089 : 033745C1;
-08A : 85136285;
+08A : 07370004;
-08B : 241DFB42;
+08B : 03B70200;
-08C : 27374321;
+08C : 20230080;
-08D : D3B745C1;
+08D : 8C13005A;
-08E : 0CB778DA;
+08E : 4A05ECBC;
-08F : 05B70004;
+08F : 8B934981;
-090 : 06370200;
+090 : 0D37BA17;
-091 : 20230080;
+091 : 0C934000;
-092 : 4981006A;
+092 : 0D93FFF3;
-093 : 0B934A05;
+093 : 041302D0;
-094 : 8C13BA17;
+094 : 8A93FFF7;
-095 : 0D37ECB3;
+095 : 85B30013;
-096 : 1CFD4000;
+096 : 85330379;
-097 : 02D00D93;
+097 : 95E201A9;
-098 : FFF58413;
+098 : 7633229D;
-099 : 00160A93;
+099 : E619019A;
-09A : 03798833;
+09A : 00094683;
-09B : 01A98533;
+09B : CCD00023;
-09C : 018805B3;
+09C : 01B90023;
-09D : 78B32295;
+09D : 0004A803;
-09E : 9863019A;
+09E : 88B30A05;
-09F : 46830008;
+09F : F9B34109;
-0A0 : 00230009;
+0A0 : 1AE30088;
-0A1 : 0023C4D0;
+0A1 : 2973FD5A;
-0A2 : AE0301B9;
+0A2 : 6E55C010;
-0A3 : 0A050004;
+0A3 : 820E0E93;
-0A4 : 41C98EB3;
+0A4 : 41690B33;
-0A5 : 008EF9B3;
+0A5 : 03DB55B3;
-0A6 : FD5A18E3;
+0A6 : 05136F05;
-0A7 : C0102973;
+0A7 : 0DB7110F;
-0A8 : 0F936F55;
+0A8 : 22CD4008;
-0A9 : 0B33820F;
+0A9 : 0004AF83;
-0AA : 55B34169;
+0AA : 0737450D;
-0AB : 650503FB;
+0AB : 02B34000;
-0AC : FE050513;
+0AC : FBB303F5;
-0AD : 40080DB7;
+0AD : D7930082;
-0AE : A2832AC9;
+0AE : CC330172;
-0AF : 478D0004;
+0AF : 7D1300FB;
-0B0 : 400005B7;
+0B0 : 6313FF8C;
-0B1 : 02578333;
+0B1 : A023004D;
-0B2 : 00837733;
+0B2 : C4B70064;
-0B3 : 01735B93;
+0B3 : 8C93DEAD;
-0B4 : 017743B3;
+0B4 : 80BAEEF4;
-0B5 : FF83FC13;
+0B5 : 0190A023;
-0B6 : 004C6D13;
+0B6 : 1CE30711;
-0B7 : 01A4A023;
+0B7 : 2473FFB7;
-0B8 : DEADC4B7;
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+150 : 20800793;
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+151 : 00F11A23;
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-3A7 : 80820141;
+3A7 : 00592023;
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+3A8 : 40F24501;
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+3B6 : 0F1320F5;
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+3B7 : 0E9300B4;
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-3BD : 00000073;
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+3BF : 01C8A223;
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-3C2 : 70250A0D;
+3C2 : 00350393;
-3C3 : 72203A20;
+3C3 : FFC3F413;
-3C4 : 20646165;
+3C4 : FA850BE3;
-3C5 : 78383025;
+3C5 : 40A405B3;
-3C6 : 70786520;
+3C6 : 28AD854A;
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+3C7 : FB3515E3;
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+3C8 : 1101B7AD;
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+3CA : C84ACA26;
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+3CF : 4A2249B2;
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-3DB : 00000000;
+3DB : 84CA0015;
-3DC : 34302520;
+3DC : FC87EEE3;
-3DD : 30252E78;
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-3DE : 00007834;
+3DE : 84AA3D5D;
-3DF : 74736554;
+3DF : 8622D961;
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+3E0 : 0089F363;
-3E1 : 41524453;
+3E1 : 85CA864E;
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-3E3 : 30206D6F;
+3E3 : 855285CA;
-3E4 : 38302578;
+3E4 : BF6D33F9;
-3E5 : 6F742078;
+3E5 : C4221141;
-3E6 : 25783020;
+3E6 : 842AC226;
-3E7 : 2C783830;
+3E7 : C606852E;
-3E8 : 72747320;
+3E8 : 8801A023;
-3E9 : 20656469;
+3E9 : 57FD2825;
-3EA : 30257830;
+3EA : 00F51863;
-3EB : 2E2E7838;
+3EB : 8801A083;
-3EC : 000A0D2E;
+3EC : 00008463;
-3ED : 65520A0D;
+3ED : 00142023;
-3EE : 6E696461;
+3EE : 442240B2;
-3EF : 61622067;
+3EF : 01414492;
-3F0 : 74206B63;
+3F0 : 80828082;
-3F1 : 6863206F;
+3F1 : A7838082;
-3F2 : 206B6365;
+3F2 : 8513FFC5;
-3F3 : 20726F66;
+3F3 : D663FFC7;
-3F4 : 61696C61;
+3F4 : 95AA0007;
-3F5 : 2E736573;
+3F5 : 0005A283;
-3F6 : 0A0D2E2E;
+3F6 : 80829516;
-3F7 : 00000000;
+3F7 : 87931141;
-3F8 : 5244530D;
+3F8 : C6068841;
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+3F9 : 0007A083;
-3FA : 20747365;
+3FA : 829386AA;
-3FB : 706D6F63;
+3FB : 93638841;
-3FC : 6574656C;
+3FC : 08930200;
-3FD : 6974202C;
+3FD : 45010D60;
-3FE : 3D20656D;
+3FE : 00000073;
-3FF : 20752520;
+3FF : 1963537D;
-400 : 0A0D736D;
+400 : 28050065;
-401 : 00000000;
+401 : C1104631;
-402 : 202A2A2A;
+402 : 40B2557D;
-403 : 6E696F44;
+403 : 80820141;
-404 : 65722067;
+404 : 00A2A023;
-405 : 20746573;
+405 : 0002A383;
-406 : 0D2A2A2A;
+406 : 0D600893;
-407 : 00000A0A;
+407 : 007685B3;
-408 : 2A0A0A0D;
+408 : 0073852E;
-409 : 48202A2A;
+409 : 1EE30000;
-40A : 6F6C6C65;
+40A : A023FCB5;
-40B : 6F57202C;
+40B : 851E00A2;
-40C : 21646C72;
+40C : A503BFE9;
-40D : 2A2A2A20;
+40D : 80828681;
-40E : 69460A0D;
+40E : 70250A0D;
-40F : 61776D72;
+40F : 72203A20;
-410 : 63206572;
+410 : 20646165;
-411 : 69706D6F;
+411 : 78383025;
-412 : 2064656C;
+412 : 70786520;
-413 : 203A6E6F;
+413 : 65746365;
-414 : 2074634F;
+414 : 30252064;
-415 : 32203420;
+415 : 0A0D7838;
-416 : 20313230;
+416 : 00000000;
-417 : 333A3030;
+417 : 73696854;
-418 : 30353A32;
+418 : 20736920;
-419 : 000A0A0D;
+419 : 706F6F6C;
-41A : 2B302D23;
+41A : 7525203A;
-41B : 00000020;
+41B : 0000000A;
-41C : 004C6C68;
+41C : 41524453;
-41D : 45676665;
+41D : 6F64204D;
-41E : 00004746;
+41E : 6F6C6E77;
-41F : 33323130;
+41F : 74206461;
-420 : 37363534;
+420 : 206B6F6F;
-421 : 42413938;
+421 : 75207525;
-422 : 46454443;
+422 : 00000A73;
-423 : 00000000;
+423 : 252F7525;
-424 : 33323130;
+424 : 6F772075;
-425 : 37363534;
+425 : 20736472;
-426 : 62613938;
+426 : 0A0A4B4F;
-427 : 66656463;
+427 : 00000000;
-428 : 00000000;
+428 : 34302520;
-429 : 00000A48;
+429 : 30252E78;
-42A : 00000A5E;
+42A : 00007834;
-42B : 00000A22;
+42B : 74736554;
-42C : 00000A22;
+42C : 20676E69;
-42D : 00000A22;
+42D : 41524453;
-42E : 00000A22;
+42E : 7266204D;
-42F : 00000A5E;
+42F : 30206D6F;
-430 : 00000A22;
+430 : 38302578;
-431 : 00000A22;
+431 : 6F742078;
-432 : 00000A22;
+432 : 25783020;
-433 : 00000A22;
+433 : 2C783830;
-434 : 00000BA0;
+434 : 72747320;
-435 : 00000A9A;
+435 : 20656469;
-436 : 00000B4A;
+436 : 30257830;
-437 : 00000A22;
+437 : 2E2E7838;
-438 : 00000A22;
+438 : 000A0D2E;
-439 : 00000BD0;
+439 : 65520A0D;
-43A : 00000A22;
+43A : 6E696461;
-43B : 00000A9A;
+43B : 61622067;
-43C : 00000A22;
+43C : 74206B63;
-43D : 00000A22;
+43D : 6863206F;
-43E : 00000B52;
+43E : 206B6365;
-43F : 00000000;
+43F : 20726F66;
-440 : 00000000;
+440 : 61696C61;
-441 : 00000396;
+441 : 2E736573;
-442 : 00000368;
+442 : 0A0D2E2E;
 443 : 00000000;
-444 : 00000000;
+444 : 5244530D;
-445 : 00000000;
+445 : 74204D41;
-446 : 00000000;
+446 : 20747365;
-447 : 00000000;
+447 : 706D6F63;
-448 : 00000000;
+448 : 6574656C;
-449 : 00000000;
+449 : 6974202C;
-44A : 00000000;
+44A : 3D20656D;
-44B : 00000000;
+44B : 20752520;
-44C : 00000000;
+44C : 0A0D736D;
 44D : 00000000;
-44E : 00000000;
+44E : 202A2A2A;
-44F : 00000000;
+44F : 6E696F44;
-450 : 00000000;
+450 : 65722067;
-451 : 00000000;
+451 : 20746573;
-452 : 00000000;
+452 : 0D2A2A2A;
-453 : 00000000;
+453 : 00000A0A;
-454 : 00000000;
+454 : 2A0A0A0D;
-455 : 00000000;
+455 : 48202A2A;
-456 : 00000000;
+456 : 6F6C6C65;
-457 : 00000000;
+457 : 6F57202C;
-458 : 00000000;
+458 : 21646C72;
-459 : 00000000;
+459 : 2A2A2A20;
-45A : 00000000;
+45A : 69460A0D;
-45B : 00000001;
+45B : 61776D72;
-45C : 00000004;
+45C : 63206572;
-45D : 0000110C;
+45D : 69706D6F;
-[45E..7FF] : 00;
+45E : 2064656C;
+45F : 203A6E6F;
+460 : 2074634F;
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+4A4 : 00000000;
+4A5 : 00000000;
+4A6 : 00000000;
+4A7 : 00000001;
+4A8 : 00000004;
+4A9 : 0000123C;
+[4AA..7FF] : 00;
 END;

fw/console.c

@@ -26,7 +26,9 @@ void con_set_baudrate(uint32_t b)
 
 void con_putc(char c)
 {
-    /* XXX: need status register to delay on FIFO full */
+    while (CON_STATUS & (1 << 4))
+	/* wait for FIFO to drain some */
+	;
     if (c == '\n')
 	CONSOLE = '\r';
     CONSOLE = c;

fw/hello.c

@@ -87,7 +87,7 @@ static void test_sdram(void)
     }
 
     con_printf("\rSDRAM test complete, time = %u ms\r\n",
-	       (rdtime() - start_time)/(CPU_CLK_HZ/1000));
+	       (rdtime() - start_time)/(CPU_HZ/1000));
 
     stride *= 3;
     stride = (stride & SDRAM_MASK) ^ (stride >> (SDRAM_ADDR_BITS-2));
@@ -119,7 +119,7 @@ void main(void)
     con_puts(hello);
 
     con_printf("This is loop: %u\n", loops++);
-    con_printf("SDRAM download took %u us\n", done/(CPU_CLK_HZ/1000000));
+    con_printf("SDRAM download took %u us\n", done/(CPU_HZ/1000000));
 
     volatile uint32_t *p = (uint32_t *)SDRAM_ADDR;
     const unsigned int words = 128*1024;
@@ -143,7 +143,6 @@ void main(void)
 	    con_printf(" %04x.%04x", l, h);
 	}
 	con_putc('\n');
-	udelay(8000);
     }
 
     test_sdram();

fw/io.h

@@ -28,7 +28,7 @@ static inline uint64_t rdtimeq(void)
 
 static inline void udelay(uint32_t us)
 {
-    uint32_t cycles = us * (CPU_CLK_HZ / 1000000);
+    uint32_t cycles = us * (CPU_HZ / 1000000);
     uint32_t start = rdtime();
 
     while (rdtime() - start < cycles)

fw/iodev.h

@@ -34,16 +34,20 @@
 
 #endif
 
-#define CPU_CLK_HZ	84000000
+#define CPU_HZ		84000000
 
 #define LED		IODEVB(0,0)
-#define CONSOLE		IODEVB(1,0)
-#define CON_BAUDDIV	IODEVL(1,1)
-#define CON_BAUD_BASE	(84000000U >> 4)
-#define CON_BAUD_BITS	24
 
-#define ROMCOPY_DONE	IODEVL(2,0)
+#define RESET_CMD	IODEVL(1,0)
+
+#define ROMCOPY_DONE	IODEVRL(2,0)
 
-#define RESET_CMD	IODEVL(15,0)
+#define CONSOLE		IODEVB(3,0)
+#define CON_BAUDDIV	IODEVL(3,1)
+#define CON_BAUD_BASE	(CPU_HZ >> 4)
+#define CON_BAUD_BITS	24
+#define CON_STATUS	IODEVRL(3,2)
+#define CON_IRQEN	IODEVL(3,3)
 
 #endif /* IODEV_H */
+