Use waitirq rather than suspending a memory transaction for SD card

When the memory is suspended by withholding mem_ready, there is no way
for the CPU to abort to take an interrupt (and such a feature would
have to be *very* carefully implemented to avoid problems with
non-idempotent accesses.)

Instead, use the augmented waitirq instruction to hold the CPU until
the SD card interrupt line becomes pending, even though the interrupt
isn't enabled. The new mask argumetns to waitirq allows narrowing down
the exit conditions to *only* the SD card.

This isn't great for code density, but allows waiting for the SD card
without disabling interrupts and without using a loop (which is slower
and larger.)

Change the layout of the memory so that .bss comes immediately after
.sbss, so both can be cleared.

fpga/abcbus.sv

@@ -295,17 +295,18 @@ module abcbus (
 			.data_b    ( { cpu_wdata[8:0],
 				       abcmap_masked_rdwr,
 				       cpu_wdata[24:0] } ),
-			.wren_b    ( valid_map & cpu_wstrb[0] ),
+			.wren_b    ( map_valid & cpu_wstrb[0] ),
 			.byteena_b ( { cpu_addr[10],
 				       {3{~cpu_addr[10]}} } ),
 
 			.q_b       ( rdata_abcmemmap )
 			);
 
-   assign iodev_rdata_abcmemmap = cpu_addr[10] ?
-				  { 23'b0, rdata_abcmemmap[35:27] } :
-				  { rdata_abcmemmap[26:25], 5'b0,
-				    rdata_abcmemmap[24:0] };
+   assign cpu_rdata_map = cpu_addr[10] ?
+			  { 23'b0, rdata_abcmemmap[35:27] } :
+			  { rdata_abcmemmap[26:25], 5'b0,
+			    rdata_abcmemmap[24:0] };
+
    reg [24:4] abc_iobase;
    reg	      abc_memrd_en;
    reg	      abc_memwr_en;

fpga/max80.qsf

@@ -251,4 +251,5 @@ set_global_assignment -name POWER_REPORT_POWER_DISSIPATION ON
 set_global_assignment -name POWER_USE_DEVICE_CHARACTERISTICS MAXIMUM
 set_global_assignment -name POWER_USE_TA_VALUE 35
 
-set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top
+
+set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top

fpga/max80.sv

@@ -413,6 +413,9 @@ module max80
    reg  [31:0] sys_irq_q;
    reg  [31:0] cpu_irq;
 
+   // CPU permanently hung?
+   wire	       cpu_trap;
+
    always @(negedge rst_n or posedge sys_clk)
      if (~rst_n)
        begin
@@ -455,7 +458,7 @@ module max80
    cpu (
 	.clk ( sys_clk ),
 	.resetn ( rst_n ),
-	.trap ( ),
+	.trap ( cpu_trap ),
 
 	.progaddr_reset ( 32'h0000_0000 ),
 	.progaddr_irq   ( 32'h0000_0020 ),
@@ -552,7 +555,10 @@ module max80
    assign sysreg_rdata[1] = { 31'b0, rtc_32khz_rework };
 
    // Hard system reset under program control
-   assign reset_cmd = sysreg[3] & cpu_mem_wstrb[0] & cpu_mem_wdata[0];
+   assign reset_cmd =
+		     (sysreg[3] & cpu_mem_wstrb[0] & cpu_mem_wdata[0])
+		     | cpu_trap; // CPU hung
+
 
   // LED indication from the CPU
    reg [2:0]   led_q;

fpga/picorv32.v

@@ -185,6 +185,7 @@ module picorv32 #(
         localparam integer qreg_offset  = qreg_count; // 0 for no qregs
         localparam integer regfile_size = xreg_count + qreg_count;
         localparam integer regindex_bits = $clog2(regfile_size);
+	wire [regindex_bits-1:0] xreg_mask = xreg_count - 1;
 
 	localparam WITH_PCPI = ENABLE_PCPI || ENABLE_MUL || ENABLE_FAST_MUL || ENABLE_DIV;
 
@@ -896,7 +897,6 @@ module picorv32 #(
 			instr_jal     <= mem_rdata_latched[6:0] == 7'b1101111;
 			instr_jalr    <= mem_rdata_latched[6:0] == 7'b1100111 && mem_rdata_latched[14:12] == 3'b000;
 			instr_retirq  <= instr_la_retirq;
-			instr_waitirq <= mem_rdata_latched[6:0] == 7'b0001011 && mem_rdata_latched[14:12] == 3'b000 && mem_rdata_latched[31:25] == 7'b0000100 && ENABLE_IRQ;
 
 			is_beq_bne_blt_bge_bltu_bgeu <= mem_rdata_latched[6:0] == 7'b1100011;
 			is_lb_lh_lw_lbu_lhu          <= mem_rdata_latched[6:0] == 7'b0000011;
@@ -1129,9 +1129,10 @@ module picorv32 #(
 					(COMPRESSED_ISA && mem_rdata_q[15:0] == 16'h9002));
 
 			instr_maskirq <= mem_rdata_q[6:0] == 7'b0001011 && mem_rdata_q[14:12] == 3'b000 && mem_rdata_q[31:25] == 7'b0000011 && ENABLE_IRQ;
+			instr_waitirq <= mem_rdata_q[6:0] == 7'b0001011 && mem_rdata_q[14:12] == 3'b000 && mem_rdata_q[31:25] == 7'b0000100 && ENABLE_IRQ;
 			instr_timer   <= mem_rdata_q[6:0] == 7'b0001011 && mem_rdata_q[14:12] == 3'b000 && mem_rdata_q[31:25] == 7'b0000101 && ENABLE_IRQ && ENABLE_IRQ_TIMER;
 			// instr_addqxi includes addxqi; instr_addxqi is only used for debug
-		        instr_addqxi  <= mem_rdata_q[6:0] == 7'b0001011 && mem_rdata_q[14:13] == 2'b01 && ENABLE_IRQ && ENABLE_IRQ_QREGS;
+		        instr_addqxi  <= mem_rdata_q[6:0] == 7'b0001011 && mem_rdata_q[14:13] == 2'b01  && ENABLE_IRQ && ENABLE_IRQ_QREGS;
 		        instr_addxqi  <= mem_rdata_q[6:0] == 7'b0001011 && mem_rdata_q[14:12] == 3'b011 && ENABLE_IRQ && ENABLE_IRQ_QREGS;
 
 			is_slli_srli_srai <= is_alu_reg_imm && |{
@@ -1376,7 +1377,7 @@ module picorv32 #(
 
 `ifndef PICORV32_REGS
 	always @(posedge clk) begin
-		if (resetn && cpuregs_write && (latched_rd & 5'h1f))
+		if (resetn && cpuregs_write && (latched_rd & xreg_mask))
 `ifdef PICORV32_TESTBUG_001
 			cpuregs[latched_rd ^ 1] <= cpuregs_wrdata;
 `elsif PICORV32_TESTBUG_002
@@ -1397,21 +1398,21 @@ module picorv32 #(
 		        cpuregs_rs1 = cpuregs[decoded_rs1];
 			cpuregs_rs2 = cpuregs[decoded_rs2];
 		        if (!REGS_INIT_ZERO) begin
-				if (!(decoded_rs1 & 5'h1f)) cpuregs_rs1 = 32'h0;
-				if (!(decoded_rs2 & 5'h1f)) cpuregs_rs2 = 32'h0;
+				if (!(decoded_rs1 & xreg_mask)) cpuregs_rs1 = 32'h0;
+				if (!(decoded_rs2 & xreg_mask)) cpuregs_rs2 = 32'h0;
 			end
 `else
-		        cpuregs_rs1 = (decoded_rs1 & 5'h1f) ? $anyseq : 32'h0;
-		        cpuregs_rs2 = (decoded_rs2 & 5'h1f) ? $anyseq : 32'h0;
+		        cpuregs_rs1 = (decoded_rs1 & xreg_mask) ? $anyseq : 32'h0;
+		        cpuregs_rs2 = (decoded_rs2 & xreg_mask) ? $anyseq : 32'h0;
 `endif
 		end else begin
 			decoded_rs = (cpu_state == cpu_state_ld_rs2) ? decoded_rs2 : decoded_rs1;
 `ifndef RISCV_FORMAL_BLACKBOX_REGS
 			cpuregs_rs1 = cpuregs[decoded_rs];
 			if (!REGS_INIT_ZERO)
-				if (!(decoded_rs & 5'h1f)) cpuregs_rs1 = 32'h0;
+				if (!(decoded_rs & xreg_mask)) cpuregs_rs1 = 32'h0;
 `else
-			cpuregs_rs1 = decoded_rs & 5'h1f ? $anyseq : 0;
+			cpuregs_rs1 = decoded_rs & xreg_mask ? $anyseq : 0;
 `endif
 			cpuregs_rs2 = cpuregs_rs1;
 		end
@@ -1438,11 +1439,11 @@ module picorv32 #(
 	always @* begin
 		decoded_rs = 'bx;
 		if (ENABLE_REGS_DUALPORT) begin
-			cpuregs_rs1 = decoded_rs1 & 4'h1f ? cpuregs_rdata1 : 0;
-			cpuregs_rs2 = decoded_rs2 & 4'h1f ? cpuregs_rdata2 : 0;
+			cpuregs_rs1 = decoded_rs1 & xreg_mask ? cpuregs_rdata1 : 0;
+			cpuregs_rs2 = decoded_rs2 & xreg_mask ? cpuregs_rdata2 : 0;
 		end else begin
 			decoded_rs = (cpu_state == cpu_state_ld_rs2) ? decoded_rs2 : decoded_rs1;
-			cpuregs_rs1 = decoded_rs & 4'h1f ? cpuregs_rdata1 : 0;
+			cpuregs_rs1 = decoded_rs & xreg_mask ? cpuregs_rdata1 : 0;
 			cpuregs_rs2 = cpuregs_rs1;
 		end
 	end
@@ -1594,14 +1595,20 @@ module picorv32 #(
 				        latched_rd <= qreg_offset |
 						      (irq_state[0] ? MASK_IRQ_REG : RA_IRQ_REG);
 				end else
-				if (ENABLE_IRQ && (decoder_trigger || do_waitirq) && instr_waitirq) begin
-					if (&(irq_pending | ~cpuregs_rs1) | |(irq_pending & cpuregs_rs2)) begin
+				if (ENABLE_IRQ && do_waitirq) begin
+					if (&(irq_pending | ~reg_op1) || |(irq_pending & reg_op2)) begin
+						// Waited-for interrupt
 						latched_store <= 1;
 						reg_out <= irq_pending;
 						reg_next_pc <= current_pc + (compressed_instr ? 2 : 4);
-						mem_do_rinst <= 1;
-					end else
+					end else if (decoder_trigger && !irq_active && !irq_delay && |(irq_pending & ~irq_mask)) begin
+						// Allow non-waited-for interrupt to be taken; in this case
+						// PC is *not* advanced so the interrupt routine will return
+						// to waitirq.
+						do_waitirq <= 0;
+					end else begin
 						do_waitirq <= 1;
+					end
 				end else
 				if (decoder_trigger) begin
 					`debug($display("-- %-0t pc: 0x%08x irq: %x", $time, current_pc, irq_active);)
@@ -1717,7 +1724,20 @@ module picorv32 #(
 						irq_mask <= ((irq_mask & cpuregs_rs2) ^ cpuregs_rs1) | MASKED_IRQ;
 						dbg_rs1val <= cpuregs_rs1;
 						dbg_rs1val_valid <= 1;
+						dbg_rs2val <= cpuregs_rs2;
+						dbg_rs2val_valid <= 1;
 						cpu_state <= cpu_state_fetch;
+					end // case: ENABLE_IRQ && instr_maskirq
+					ENABLE_IRQ && instr_waitirq: begin
+						reg_op1    <= cpuregs_rs1;
+						reg_op2    <= cpuregs_rs2;
+						dbg_rs1val <= cpuregs_rs1;
+						dbg_rs1val_valid <= 1;
+						dbg_rs2val <= cpuregs_rs2;
+						dbg_rs2val_valid <= 1;
+						do_waitirq <= 1;
+					        reg_next_pc <= reg_pc;
+						cpu_state  <= cpu_state_fetch;
 					end
 					ENABLE_IRQ && ENABLE_IRQ_TIMER && instr_timer: begin
 						latched_store <= 1;

fpga/sdcard.sv

@@ -140,7 +140,8 @@ module sdcard
      else
        sd_cmd_ok <= valid_blocking & (~sd_active | sd_cmd_ok);
 
-   assign wait_n = ~(valid_blocking & sd_active) | sd_cmd_ok;
+   //assign wait_n = ~(valid_blocking & sd_active) | sd_cmd_ok;
+   assign wait_n = 1'b1;
 
    // Valid *nonblocking* command
    wire       sd_cmd_nonblock = valid & (addr[4:2] == 3'b000);

fw/boot.mif

@@ -10,7 +10,7 @@ CONTENT BEGIN
 0003 : FF818193;
 0004 : 0001A18B;
 0005 : 08502423;
-0006 : 49E0006F;
+0006 : 6F00006F;
 0007 : 00000000;
 0008 : 0001210B;
 0009 : 00000493;
@@ -39,19 +39,19 @@ CONTENT BEGIN
 0020 : 30200073;
 0021 : 00000000;
 0022 : 00000000;
-0023 : 0000051A;
-0024 : 0000051A;
-0025 : 0000051A;
-0026 : 000005A6;
-0027 : 0000051A;
-0028 : 0000051A;
-0029 : 0000051A;
-002A : 0000051A;
-002B : 0000051A;
-002C : 00003CB0;
+0023 : 0000076C;
+0024 : 0000076C;
+0025 : 0000076C;
+0026 : 000007F8;
+0027 : 0000076C;
+0028 : 0000076C;
+0029 : 0000076C;
+002A : 0000076C;
+002B : 0000076C;
+002C : 00003DF0;
 002D : 00000001;
 002E : 00000004;
-002F : 00003A04;
+002F : 00003D84;
 0030 : 00000000;
 0031 : 00000000;
 0032 : 00000000;
@@ -63,3683 +63,3907 @@ CONTENT BEGIN
 0038 : 00000000;
 0039 : 00000000;
 003A : 00000000;
-003B : C686715D;
-003C : C2A6C4A2;
-003D : DE4EC0CA;
-003E : DA56DC52;
-003F : D65ED85A;
-0040 : D266D462;
-0041 : CE6ED06A;
-0042 : 81002483;
-0043 : DCED8885;
-0044 : C0102473;
-0045 : 08802083;
-0046 : 073776ED;
-0047 : 0A33C000;
-0048 : 49814014;
-0049 : 80068293;
-004A : 7FF00513;
-004B : 68917861;
-004C : C0000337;
-004D : 80000E37;
-004E : 8EB365C1;
-004F : 863A0059;
-0050 : 6B630711;
-0051 : E93335D5;
-0052 : 202301C9;
-0053 : 89930126;
-0054 : 94E32009;
-0055 : 0AB7FEB9;
-0056 : 8C93C000;
-0057 : 8B13200A;
-0058 : A023400A;
-0059 : A023000C;
-005A : A223400C;
-005B : 8B93000C;
-005C : 8C13400C;
-005D : 2023404C;
-005E : 0CA1000C;
-005F : FF6C93E3;
-0060 : 05136D71;
-0061 : 293D138D;
-0062 : 85136D8D;
-0063 : 2423488D;
-0064 : 29858000;
-0065 : 0CC00F13;
-0066 : 000F2023;
-0067 : C0102FF3;
-0068 : 0DF02823;
-0069 : 56DD4781;
-006A : 06D7878B;
-006B : 3CF000EF;
-006C : 0B400513;
-006D : 688D410C;
-006E : 0CC00993;
-006F : 00158813;
-0070 : 01052023;
-0071 : 31488513;
-0072 : 0313298D;
-0073 : 55B30540;
-0074 : 6A0D026A;
-0075 : 328A0513;
-0076 : 0D000913;
-0077 : 0E1329B9;
-0078 : 2583B000;
-0079 : F613000E;
-007A : 01630015;
-007B : 27032C06;
-007C : 0593000E;
-007D : 7E933200;
-007E : 94630047;
-007F : 0593000E;
-0080 : 638D0500;
-0081 : 34438513;
-0082 : 6A85290D;
-0083 : 1D951BB7;
-0084 : 89ABDCB7;
-0085 : 111A8413;
-0086 : C84B8D93;
-0087 : 40000A37;
-0088 : 0B374C21;
-0089 : 6D0D0002;
-008A : DEFC8A93;
-008B : 40080BB7;
-008C : 000A2603;
-008D : 00860B63;
-008E : 08631B7D;
-008F : 86A2000C;
-0090 : 051385D2;
-0091 : 1C7D384D;
-0092 : 0F332ECD;
-0093 : 0A1103BA;
-0094 : 03540FB3;
-0095 : 03543433;
-0096 : 01FF07B3;
-0097 : 19E3943E;
-0098 : 668DFD7A;
-0099 : 063785DA;
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-009B : 26F13A46;
-009C : 40000B37;
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-009F : 0A938BDA;
-00A0 : 82DE020B;
-00A1 : 000BD583;
-00A2 : 0022D603;
-00A3 : 05130B91;
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-00A5 : FF5B97E3;
-00A6 : 9B6E4529;
-00A7 : 1FE326A1;
-00A8 : 00EFFD9B;
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-00AA : 0513C010;
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-00AF : 2EB53C48;
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-00BF : 20234581;
-00C0 : 2CA90004;
-00C1 : 852255FD;
-00C2 : 01B42023;
-00C3 : 45932C81;
-00C4 : C00CFFFB;
-00C5 : 24998522;
-00C6 : 852285DA;
-00C7 : 01642023;
-00C8 : 0EB32C35;
-00C9 : 8522039B;
-00CA : 01AE85B3;
-00CB : 243DC00C;
-00CC : 0F3743B2;
-00CD : 0F930004;
-00CE : 06B7FFFF;
-00CF : 08370200;
-00D0 : F7B30080;
-00D1 : 02B701F3;
-00D2 : 85134000;
-00D3 : 0893FFF6;
-00D4 : 03130018;
-00D5 : E79902D0;
-00D6 : 000AC083;
-00D7 : 90100023;
-00D8 : 006A8023;
-00D9 : 000A2E03;
-00DA : 00138593;
-00DB : 7B339B72;
-00DC : 91E300AB;
-00DD : 6D8DF915;
-00DE : 3FCD8513;
-00DF : 46212459;
-00E0 : 00040437;
-00E1 : 00CBA023;
-00E2 : 78DAD737;
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+0E52 : 6F726620;
+0E53 : 7025206D;
+0E54 : 0000000A;
+0E55 : 61636473;
+0E56 : 203A6472;
+0E57 : 74697277;
+0E58 : 756D5F65;
+0E59 : 7069746C;
+0E5A : 6520656C;
+0E5B : 726F7272;
+0E5C : 32302520;
+0E5D : 00000A78;
+0E5E : 61636473;
+0E5F : 203A6472;
+0E60 : 65736572;
+0E61 : 61662074;
+0E62 : 64656C69;
+0E63 : 7361202C;
+0E64 : 696D7573;
+0E65 : 6E20676E;
+0E66 : 6163206F;
+0E67 : 70206472;
+0E68 : 65736572;
+0E69 : 000A746E;
+0E6A : 61636473;
+0E6B : 203A6472;
+0E6C : 38444D43;
+0E6D : 70657220;
+0E6E : 7374726F;
+0E6F : 756E7520;
+0E70 : 6C626173;
+0E71 : 61632065;
+0E72 : 28206472;
+0E73 : 78257830;
+0E74 : 00000A29;
+0E75 : 61636473;
+0E76 : 203A6472;
+0E77 : 444D4341;
+0E78 : 65203134;
+0E79 : 726F7272;
+0E7A : 32302520;
+0E7B : 00000A78;
+0E7C : 61636473;
+0E7D : 203A6472;
+0E7E : 35444D43;
+0E7F : 72652038;
+0E80 : 20726F72;
+0E81 : 78323025;
+0E82 : 0000000A;
+0E83 : 61636473;
+0E84 : 203A6472;
+0E85 : 31444D43;
+0E86 : 72726520;
+0E87 : 2520726F;
+0E88 : 0A783230;
 0E89 : 00000000;
-0E8A : 00000000;
-0E8B : 00000000;
-0E8C : 00000000;
-0E8D : 00000000;
-0E8E : 00000000;
-0E8F : 00000000;
-0E90 : 00000000;
-0E91 : 00000000;
-0E92 : 00000000;
-0E93 : 00000000;
-0E94 : 00000000;
-0E95 : 00000000;
-0E96 : 00000000;
-0E97 : 00000000;
-0E98 : 00000000;
-[0E99..1FFF] : 00;
+0E8A : 61636473;
+0E8B : 203A6472;
+0E8C : 31444D43;
+0E8D : 72652036;
+0E8E : 20726F72;
+0E8F : 78323025;
+0E90 : 0000000A;
+0E91 : 00445343;
+0E92 : 00444943;
+0E93 : 61636473;
+0E94 : 203A6472;
+0E95 : 63207325;
+0E96 : 20647261;
+0E97 : 6E756F66;
+0E98 : 63202C64;
+0E99 : 63617061;
+0E9A : 20797469;
+0E9B : 73207525;
+0E9C : 6F746365;
+0E9D : 000A7372;
+0E9E : 61636473;
+0E9F : 203A6472;
+0EA0 : 76206F6E;
+0EA1 : 6D756C6F;
+0EA2 : 6F662065;
+0EA3 : 0A646E75;
+0EA4 : 00000000;
+0EA5 : 61636473;
+0EA6 : 203A6472;
+0EA7 : 756C6F76;
+0EA8 : 6620656D;
+0EA9 : 646E756F;
+0EAA : 616C202C;
+0EAB : 206C6562;
+0EAC : 22732522;
+0EAD : 6F76202C;
+0EAE : 2064696C;
+0EAF : 78383025;
+0EB0 : 0000000A;
+0EB1 : 61636473;
+0EB2 : 203A6472;
+0EB3 : 252F7525;
+0EB4 : 6C632075;
+0EB5 : 65747375;
+0EB6 : 66207372;
+0EB7 : 2C656572;
+0EB8 : 756C6320;
+0EB9 : 72657473;
+0EBA : 203D2073;
+0EBB : 62207525;
+0EBC : 73657479;
+0EBD : 0000000A;
+0EBE : 6E6B6E75;
+0EBF : 006E776F;
+0EC0 : 4D2F4453;
+0EC1 : 0000434D;
+0EC2 : 43484453;
+0EC3 : 5844532F;
+0EC4 : 4D652F43;
+0EC5 : 0000434D;
+0EC6 : 00003AF8;
+0EC7 : 00003B00;
+0EC8 : 00003B08;
+0EC9 : 52206F4E;
+0ECA : 64204354;
+0ECB : 63657465;
+0ECC : 20646574;
+0ECD : 49207461;
+0ECE : 61204332;
+0ECF : 65726464;
+0ED0 : 30207373;
+0ED1 : 32302578;
+0ED2 : 00000A78;
+0ED3 : 20435452;
+0ED4 : 69676572;
+0ED5 : 72657473;
+0ED6 : 6E6F6320;
+0ED7 : 746E6574;
+0ED8 : 00000A3A;
+0ED9 : 32302520;
+0EDA : 00000078;
+0EDB : 4354520A;
+0EDC : 6D697420;
+0EDD : 25203A65;
+0EDE : 2D753430;
+0EDF : 75323025;
+0EE0 : 3230252D;
+0EE1 : 30252075;
+0EE2 : 253A7532;
+0EE3 : 3A753230;
+0EE4 : 75323025;
+0EE5 : 0000000A;
+0EE6 : 459076EB;
+0EE7 : 54414658;
+0EE8 : 00202020;
+0EE9 : 33544146;
+0EEA : 20202032;
+0EEB : 00000000;
+0EEC : 07050301;
+0EED : 12100E09;
+0EEE : 1C181614;
+0EEF : 0000001E;
+0EF0 : 00FC00C7;
+0EF1 : 00E200E9;
+0EF2 : 00E000E4;
+0EF3 : 00E700E5;
+0EF4 : 00EB00EA;
+0EF5 : 00EF00E8;
+0EF6 : 00EC00EE;
+0EF7 : 00C500C4;
+0EF8 : 00E600C9;
+0EF9 : 00F400C6;
+0EFA : 00F200F6;
+0EFB : 00F900FB;
+0EFC : 00D600FF;
+0EFD : 00A200DC;
+0EFE : 00A500A3;
+0EFF : 019220A7;
+0F00 : 00ED00E1;
+0F01 : 00FA00F3;
+0F02 : 00D100F1;
+0F03 : 00BA00AA;
+0F04 : 231000BF;
+0F05 : 00BD00AC;
+0F06 : 00A100BC;
+0F07 : 00BB00AB;
+0F08 : 25922591;
+0F09 : 25022593;
+0F0A : 25612524;
+0F0B : 25562562;
+0F0C : 25632555;
+0F0D : 25572551;
+0F0E : 255C255D;
+0F0F : 2510255B;
+0F10 : 25342514;
+0F11 : 251C252C;
+0F12 : 253C2500;
+0F13 : 255F255E;
+0F14 : 2554255A;
+0F15 : 25662569;
+0F16 : 25502560;
+0F17 : 2567256C;
+0F18 : 25642568;
+0F19 : 25592565;
+0F1A : 25522558;
+0F1B : 256B2553;
+0F1C : 2518256A;
+0F1D : 2588250C;
+0F1E : 258C2584;
+0F1F : 25802590;
+0F20 : 00DF03B1;
+0F21 : 03C00393;
+0F22 : 03C303A3;
+0F23 : 03C400B5;
+0F24 : 039803A6;
+0F25 : 03B403A9;
+0F26 : 03C6221E;
+0F27 : 222903B5;
+0F28 : 00B12261;
+0F29 : 22642265;
+0F2A : 23212320;
+0F2B : 224800F7;
+0F2C : 221900B0;
+0F2D : 221A00B7;
+0F2E : 00B2207F;
+0F2F : 00A025A0;
+0F30 : 2B302D23;
+0F31 : 00000020;
+0F32 : 004C6C68;
+0F33 : 45676665;
+0F34 : 00004746;
+0F35 : 33323130;
+0F36 : 37363534;
+0F37 : 42413938;
+0F38 : 46454443;
+0F39 : 00000000;
+0F3A : 33323130;
+0F3B : 37363534;
+0F3C : 62613938;
+0F3D : 66656463;
+0F3E : 00000000;
+0F3F : 00003154;
+0F40 : 0000316A;
+0F41 : 00003128;
+0F42 : 00003128;
+0F43 : 00003128;
+0F44 : 00003128;
+0F45 : 0000316A;
+0F46 : 00003128;
+0F47 : 00003128;
+0F48 : 00003128;
+0F49 : 00003128;
+0F4A : 000032F8;
+0F4B : 000031BA;
+0F4C : 0000328A;
+0F4D : 00003128;
+0F4E : 00003128;
+0F4F : 00003334;
+0F50 : 00003128;
+0F51 : 000031BA;
+0F52 : 00003128;
+0F53 : 00003128;
+0F54 : 00003296;
+0F55 : 00000001;
+0F56 : 00000000;
+0F57 : 00000000;
+0F58 : 00000000;
+0F59 : 00000000;
+0F5A : 00000000;
+0F5B : 00000000;
+0F5C : 00000000;
+0F5D : 00000000;
+0F5E : 00000000;
+0F5F : 00000000;
+0F60 : 00000000;
+0F61 : 00000000;
+0F62 : 00000000;
+0F63 : 00000000;
+0F64 : 00000000;
+0F65 : 00000000;
+0F66 : 00000000;
+0F67 : 00000000;
+0F68 : 00000000;
+0F69 : 00000000;
+0F6A : 00000000;
+0F6B : 00000000;
+0F6C : 00000000;
+0F6D : 00000000;
+0F6E : 00000000;
+0F6F : 00000000;
+0F70 : 00000000;
+0F71 : 00000000;
+0F72 : 00000000;
+0F73 : 00000000;
+0F74 : 00000000;
+0F75 : 00000000;
+0F76 : 00000000;
+0F77 : 00000000;
+0F78 : 00000000;
+[0F79..1FFF] : 00;
 END;

fw/hello.c

@@ -167,7 +167,7 @@ static void init_abc_memmap(void)
 	ABCMEMMAP_RDCOUNT(sel) = 0;	/* DMA read byte count */
     }
 }
-    
+
 static uint32_t timer_irq_start;
 static void init(void)
 {

fw/io.h

@@ -51,70 +51,6 @@ static inline void udelay(uint32_t us)
 	pause();
 }
 
-static inline void sd_set_mode(uint8_t divisor, bool cs)
-{
-    SDCARD_CTL_SPEED = (divisor - 1) | (cs << 7);
-}
-
-/* Read/write SD card and start transaction */
-enum sd_data_flags {
-    SD_B0       = 0x00,		/* Byte offset 0 */
-    SD_B1       = 0x01,		/* Byte offset 1 */
-    SD_B2       = 0x02,		/* Byte offset 2 */
-    SD_B3       = 0x03,		/* Byte offset 3 */
-    SD_GO8      = 0x04,		/* Start 8-bit transaction */
-    SD_GO16     = 0x08,		/* Start 16-bit transaction */
-    SD_GO32     = 0x0c,		/* Start 32-bit transaction */
-    SD_BE       = 0x10,		/* Bigendian data */
-    SD_DATA	= 0x20,		/* Data register access (assumed) */
-    SD_CLEARCRC = 0x40		/* Clear CRC registers */
-};
-
-static inline void sd_writeb(uint8_t d, enum sd_data_flags flags)
-{
-    flags ^= (flags & SD_BE) ? 3 : 0;
-    *(volatile uint8_t *)IODEVA(SDCARD,0,flags | SD_DATA) = d;
-}
-static inline void sd_writeh(uint16_t d, enum sd_data_flags flags)
-{
-    flags ^= (flags & SD_BE) ? 2 : 0;
-    *(volatile uint16_t *)IODEVA(SDCARD,0,flags | SD_DATA) = d;
-}
-static inline void sd_writel(uint32_t d, enum sd_data_flags flags)
-{
-    *(volatile uint32_t *)IODEVA(SDCARD,0,flags | SD_DATA) = d;
-}
-static inline uint8_t sd_readb(enum sd_data_flags flags)
-{
-    flags ^= (flags & SD_BE) ? 0 : 3;
-    return *(volatile uint8_t *)IODEVA(SDCARD,0,flags | SD_DATA);
-}
-static inline uint16_t sd_readh(enum sd_data_flags flags)
-{
-    flags ^= (flags & SD_BE) ? 0 : 2;
-    return *(volatile uint16_t *)IODEVA(SDCARD,0,flags | SD_DATA);
-}
-static inline uint32_t sd_readl(enum sd_data_flags flags)
-{
-    return *(volatile uint32_t *)IODEVA(SDCARD,0,flags | SD_DATA);
-}
-
-static inline uint8_t sd_crc7_rd(void)
-{
-    return SDCARD_CRC7_RD;
-}
-static inline uint8_t sd_crc7_wr(void)
-{
-    return SDCARD_CRC7_WR;
-}
-static inline uint16_t sd_crc16_rd(void)
-{
-    return SDCARD_CRC16_RD;
-}
-static inline uint8_t sd_crc16_wr(void)
-{
-    return SDCARD_CRC16_WR;
-}
 static inline void i2c_set_speed(unsigned int khz)
 {
     I2C_DIVISOR = ((CPU_HZ/4000)-1)/khz;

fw/ioregs.h

@@ -67,11 +67,15 @@
 
 #define SDCARD_CTL		IODEVL(SDCARD,0)
 #define SDCARD_CTL_SPEED	IODEVB0(SDCARD,0)
-#define SDCARD_CTL_CLRCRC	IODEVB1(SDCARD,0)
+#define SDCARD_CTL_IRQEN	IODEVB1(SDCARD,0)
+#define SDCARD_CTL_CLRCRC	IODEVB2(SDCARD,0)
 #define SDCARD_CRC7_RD		IODEVRB0(SDCARD,4)
 #define SDCARD_CRC16_RD		IODEVRH1(SDCARD,4)
 #define SDCARD_CRC7_WR		IODEVRB0(SDCARD,5)
 #define SDCARD_CRC16_WR		IODEVRH1(SDCARD,5)
+#define SDCARD_IRQ_READY	1
+#define SDCARD_IRQ_CD		2
+#define SDCARD_IRQ_EXT		4
 
 /* Speed values, not including -1 adjustment */
 #define SD_SLOW		128	/* 328 kHz */

fw/irq.h

@@ -25,4 +25,10 @@ static inline unsigned int irqmask(void)
     return p_maskirq(0, ~0);
 }
 
+static inline unsigned int waitfor(unsigned int vector)
+{
+    const unsigned int mask = 1U << vector;
+    return p_waitirq(mask, 0);
+}
+
 #endif /* IRQ_H */

fw/max80.ld

@@ -55,7 +55,7 @@ SECTIONS
 
 	/*
 	 * Put the short data sections in the zero page.
-	 * This means .bss and .sbss aren't contiguous, but
+	 * This means the initialized sections aren't contiguous, but
 	 * all memory is intialized during FPGA load anyway.
 	 */
 	.sdata : ALIGN(4) {
@@ -64,11 +64,22 @@ SECTIONS
 		*(.srodata.cst2) *(.srodata .srodata.*)
 		*(.sdata .sdata.* .gnu.linkonce.s.*)
 	}
+	.sdata2         : {
+		*(.sdata2 .sdata2.* .gnu.linkonce.s2.*)
+	}
+	__bss_start = .;
 	.sbss : ALIGN(4) {
 		*(.dynsbss)
 		*(.sbss .sbss.* .gnu.linkonce.sb.*)
 		*(.scommon)
 	}
+	.sbss2          : { *(.sbss2 .sbss2.* .gnu.linkonce.sb2.*) }
+	.bss  : {
+		*(.dynbss)
+		*(.bss .bss.* .gnu.linkonce.b.*)
+		*(COMMON)
+	}
+	__BSS_END__ = .;
 
 	HIDDEN($assert_zero_page = ASSERT((. <= 2048), "zero page overflow"));
 
@@ -92,10 +103,6 @@ SECTIONS
 	. = ALIGN(4);
 	.rodata         : { *(.rodata .rodata.* .gnu.linkonce.r.*) }
 	.rodata1        : { *(.rodata1) }
-	.sdata2         : {
-		*(.sdata2 .sdata2.* .gnu.linkonce.s2.*)
-	}
-	.sbss2          : { *(.sbss2 .sbss2.* .gnu.linkonce.sb2.*) }
 
 	/* Thread Local Storage sections  */
 	.tdata          : {
@@ -130,19 +137,6 @@ SECTIONS
 	.data1          : { *(.data1) }
 	_edata = .;
 	. = ALIGN(16);
-	__bss_start = .;
-	.bss            : {
-		*(.dynbss)
-		*(.bss .bss.* .gnu.linkonce.b.*)
-		*(COMMON)
-   /* Align here to ensure that the .bss section occupies space up to
-      _end.  Align after .bss to ensure correct alignment even if the
-      .bss section disappears because there are no input sections.
-      FIXME: Why do we need it? When there is no .bss section, we do not
-      pad the .data section.  */
-		. = ALIGN(16);
-	}
-	. = SEGMENT_START("ldata-segment", .);
 	. = ALIGN(16);
 	__BSS_END__ = .;
 	_end = .;

fw/picorv32.h

@@ -55,7 +55,7 @@ static inline unsigned int p_timer(unsigned int newval)
 
 .macro addqxi qd, rs, imm
 	.insn i 0x0b, 0x02, \qd, \rs, \imm
-.endm  
+.endm
 .macro addxqi rd, qs, imm
 	.insn i 0x0b, 0x03, \rd, \qs, \imm
 .endm

fw/rtc.c

@@ -33,7 +33,7 @@ static bool i2c_acked(void)
 static int i2c_recv(uint8_t ctl)
 {
     uint32_t rdata;
-    
+
     i2c_wait();
 
     I2C_WDATA = (~0xff) | ctl;
@@ -57,9 +57,9 @@ void read_rtc(void)
     uint8_t rtc_regs[RTC_REGS];
     int i;
     struct tms tms;
-    
+
     i2c_set_speed(100);
-    
+
     i2c_send(RTC_WCMD, 0);
 
     if (!i2c_acked()) {
@@ -67,7 +67,7 @@ void read_rtc(void)
 	i2c_send(0xff, I2C_P);
 	return;
     }
-    
+
     i2c_send(0, I2C_SR);
     i2c_send(RTC_RCMD, 0);
 

fw/sdcard.c

@@ -27,6 +27,7 @@
 
 #include "fw.h"
 #include "io.h"
+#include "sdcard.h"
 #include "systime.h"
 #include "console.h"
 #include "ff.h"
@@ -689,6 +690,9 @@ DSTATUS disk_initialize(BYTE drive)
     if (drive != 0)
 	return STA_NOINIT;
 
+    /* So we can wait for the ready condition */
+    SDCARD_CTL_IRQEN = SDCARD_IRQ_READY;
+
     memset(&sdc, 0, sizeof sdc);
 
 #if 0
@@ -707,12 +711,10 @@ DSTATUS disk_initialize(BYTE drive)
     while (1) {
 	/*
 	 * Generate 256 clock cycles in slow mode, with CS# high.
-	 * Use byte writes to reduce the time the CPU is held blocking
-	 * interrupts. (Todo: polling loop?)
 	 */
 	sd_set_mode(SD_SLOW, false);
-	for (j = 0; j < 32; j++)
-	    sd_writeb(~0, SD_GO8);
+	for (j = 0; j < 8; j++)
+	    sd_writel(~0, SD_GO32);
 
 	/* Assert CS# and send reset command */
 	sd_set_mode(SD_SLOW, true);

fw/sdcard.h

@@ -0,0 +1,83 @@
+#ifndef SDCARD_H
+#define SDCARD_H
+
+#include "io.h"
+#include "irq.h"
+
+static inline void sd_set_mode(uint8_t divisor, bool cs)
+{
+    waitfor(SDCARD_IRQ);
+    SDCARD_CTL_SPEED = (divisor - 1) | (cs << 7);
+}
+
+/* Read/write SD card and start transaction */
+enum sd_data_flags {
+    SD_B0       = 0x00,		/* Byte offset 0 */
+    SD_B1       = 0x01,		/* Byte offset 1 */
+    SD_B2       = 0x02,		/* Byte offset 2 */
+    SD_B3       = 0x03,		/* Byte offset 3 */
+    SD_GO8      = 0x04,		/* Start 8-bit transaction */
+    SD_GO16     = 0x08,		/* Start 16-bit transaction */
+    SD_GO32     = 0x0c,		/* Start 32-bit transaction */
+    SD_BE       = 0x10,		/* Bigendian data */
+    SD_DATA	= 0x20,		/* Data register access (assumed) */
+    SD_CLEARCRC = 0x40		/* Clear CRC registers */
+};
+
+static inline void sd_writeb(uint8_t d, enum sd_data_flags flags)
+{
+    waitfor(SDCARD_IRQ);
+    flags ^= (flags & SD_BE) ? 3 : 0;
+    *(volatile uint8_t *)IODEVA(SDCARD,0,flags | SD_DATA) = d;
+}
+static inline void sd_writeh(uint16_t d, enum sd_data_flags flags)
+{
+    waitfor(SDCARD_IRQ);
+    flags ^= (flags & SD_BE) ? 2 : 0;
+    *(volatile uint16_t *)IODEVA(SDCARD,0,flags | SD_DATA) = d;
+}
+static inline void sd_writel(uint32_t d, enum sd_data_flags flags)
+{
+    waitfor(SDCARD_IRQ);
+    *(volatile uint32_t *)IODEVA(SDCARD,0,flags | SD_DATA) = d;
+}
+static inline uint8_t sd_readb(enum sd_data_flags flags)
+{
+    waitfor(SDCARD_IRQ);
+    flags ^= (flags & SD_BE) ? 0 : 3;
+    return *(volatile uint8_t *)IODEVA(SDCARD,0,flags | SD_DATA);
+}
+static inline uint16_t sd_readh(enum sd_data_flags flags)
+{
+    waitfor(SDCARD_IRQ);
+    flags ^= (flags & SD_BE) ? 0 : 2;
+    return *(volatile uint16_t *)IODEVA(SDCARD,0,flags | SD_DATA);
+}
+static inline uint32_t sd_readl(enum sd_data_flags flags)
+{
+    waitfor(SDCARD_IRQ);
+    return *(volatile uint32_t *)IODEVA(SDCARD,0,flags | SD_DATA);
+}
+
+static inline uint8_t sd_crc7_rd(void)
+{
+    waitfor(SDCARD_IRQ);
+    return SDCARD_CRC7_RD;
+}
+static inline uint8_t sd_crc7_wr(void)
+{
+    waitfor(SDCARD_IRQ);
+    return SDCARD_CRC7_WR;
+}
+static inline uint16_t sd_crc16_rd(void)
+{
+    waitfor(SDCARD_IRQ);
+    return SDCARD_CRC16_RD;
+}
+static inline uint8_t sd_crc16_wr(void)
+{
+    waitfor(SDCARD_IRQ);
+    return SDCARD_CRC16_WR;
+}
+
+#endif /* SDCARD_H */