Add i2c unit

fpga/i2c.sv

@@ -0,0 +1,205 @@
+//
+// Simple I2C master devic, controlled by programmed I/O.
+//
+// Registers:
+// 0 - write data/command
+//     [15:8] - data bits (must be 1 for read)
+//     [7]    - ACK bit (must be 1 for write)
+//     [2]    - follow with P condition
+//     [1]    - follow with Sr condition
+//
+// 1 - read data/status
+//     [15:8] - data bits
+//     [7]    - ack bit
+//     [1]    - bus idle (after P condition)
+//     [0]    - busy
+//
+// 2 - baud rate divisor (f = clk/(4*(divisor+1)))
+//
+// This unit handles S(r) and P conditions by considering two classes of
+// symbols: "normal", when SCL is asserted at the end of the 
+
+module i2c (
+	    input 	      rst_n,
+	    input 	      clk,
+	    
+	    input 	      valid,
+	    input [1:0]       addr,
+	    input [31:0]      wdata,
+	    input [3:0]       wstrb,
+	    output reg [31:0] rdata,
+	    output 	      irq,
+
+	    inout 	      i2c_scl,
+	    inout 	      i2c_sda
+	    );
+   
+   reg [7:0] 		  divisor;
+   reg [7:0] 		  baudctr;
+   reg [3:0] 		  bitctr;
+   reg [1:0] 		  phase;
+   
+   reg [8:0] 		  wreg;	// Output shift register
+   reg [8:0] 		  rreg;	// Input shift register
+   reg 			  do_read; // Shift in a data bit next cycle
+
+   reg 			  busy;		// Data received, running
+   reg 			  end_s, end_p; // Trailing S(r) or P
+   
+   reg [1:0] 		  outsymb; // Output symbol [abnormal, data]
+
+   reg 			  scl_out = 1'b1;
+   reg 			  sda_out = 1'b1;
+
+   assign i2c_scl = scl_out ? 1'bz : 1'b0;
+   assign i2c_sda = sda_out ? 1'bz : 1'b0;
+   
+   always @(negedge rst_n or posedge clk)
+     if (~rst_n)
+       begin
+	  bitctr  <= 4'd14;	// Idle line - wait for start condition
+	  busy    <= 1'b0;
+	  outsymb <= 2'b11;	// A1
+	  baudctr <= 8'd0;
+	  divisor <= 8'd209;	// 84 MHz -> 100 kHz
+	  scl_out <= 1'b1;
+	  sda_out <= 1'b1;
+	  phase   <= 2'b00;
+	  do_read <= 1'b0;
+       end
+     else
+       begin
+	  //
+	  // I2C state machine
+	  //
+	  
+	  if (|baudctr)
+	    begin
+	       baudctr <= baudctr - 1'b1;
+	    end
+	  else
+	    begin
+	       // I2C clock event
+	       baudctr <= divisor;
+
+	       phase <= phase + 1'b1;
+	       if ((phase == 2'b10) & ~i2c_scl)
+		 phase <= 2'b10; // Clock stretch
+
+	       // Phase 0: data is shifted out
+	       // Phase 1: SCL goes high
+	       // Phase 2: if SCL is low, hold
+	       // Phase 3: SCL does low if symbol is normal,
+	       //          sample SDA on read
+	       if (phase[0])
+		 scl_out <= outsymb[1] | ~phase[1];
+
+	       sda_out <= outsymb[0];
+	       
+	       if (phase == 2'b11)
+		 begin
+		    // Sample input and set up for the next cycle
+
+		    if (do_read)
+		      rreg <= { rreg[7:0], i2c_sda };
+		    
+		    do_read <= 1'b0;
+
+		    // Unit idle; send A0 or A1 depending on if we are
+		    // started or not.
+		    if (~busy)
+		      begin
+			 outsymb[1] <= 1'b1;
+		      end
+		    else
+		      begin
+			 bitctr <= bitctr + 1'b1;
+
+			 case (bitctr)
+			   4'd0, 4'd1, 4'd2, 4'd3, 4'd4,
+			   4'd5, 4'd6, 4'd7, 4'd8:
+			     begin
+				outsymb <= { 1'b0, wreg[8] }; // Nx
+				wreg   <= { wreg[7:0], 1'b1 };
+				do_read <= 1'b1;
+				if (bitctr[3])
+				  begin
+				     bitctr <= end_p ? 4'd12 :
+					       end_s ? 4'd14 : 4'd0;
+				     busy   <= end_p;
+				  end
+			     end // case: 4'd0, 4'd1, 4'd2, 4'd3, 4'd4,...
+
+			   // Stop condition
+			   4'd12: begin
+			      outsymb <= 2'b10; // A0
+			   end
+
+			   4'd13: begin
+			      outsymb <= 2'b11; // A1
+			      busy <= 1'b0;
+			   end
+
+			   // Start condition
+			   4'd14: begin
+			      outsymb <= 2'b11; // A1
+			   end
+
+			   4'd15: begin
+			      outsymb <= 2'b00; // N0
+			   end
+			   
+			   default: begin
+			      outsymb <= 2'bxx;
+			   end
+			 endcase // case (bitctr)
+		      end // else: !if(~busy)
+		 end // if (phase == 2'b11)
+	    end // else: !if(|baudctr)
+
+	  //
+	  // CPU write interface
+	  //
+	  if (valid)
+	    case (addr)
+	      2'b00:
+		 if (~busy)
+		   begin
+		      if (wstrb[1])
+			wreg[8:1] <= wdata[15:8];
+		      if (wstrb[0])
+			begin
+			   wreg[0] <= wdata[7];
+			   end_p   <= wdata[2];
+			   end_s   <= wdata[1];
+			   busy    <= 1'b1;
+			end
+		   end // if (~busy)
+	      2'b10: begin
+		if (wstrb[0])
+		  divisor <= wdata[7:0];
+	      end
+	      default: begin
+		 // Do nothing
+	      end
+	    endcase // case (addr)
+       end // else: !if(~rst_n)
+
+   //
+   // CPU read interface
+   //
+   always_comb
+     case (addr)
+       2'b00: rdata = { 16'b0, wreg, 4'b0, end_p, end_s, busy | do_read };
+       2'b01: rdata = { 16'b0, rreg, 4'b0, end_p, end_s, busy | do_read };
+       2'b10: rdata = { 24'b0, divisor };
+       default: rdata = 32'b0;
+     endcase // casez (addr)
+
+   //
+   // IRQ (edge) when unit idle
+   //
+   assign irq = ~(busy | do_read);
+   
+endmodule // i2c
+

fpga/iodevs.vh

@@ -22,14 +22,19 @@
 	wire [ 0:0] iodev_valid_sdcard = iodev_valid[3:3];
 	tri1 [ 0:0] iodev_wait_n_sdcard;
 
+	wire [31:0] iodev_rdata_i2c;
+	wire [ 0:0] iodev_irq_i2c;
+	wire [ 0:0] iodev_valid_i2c = iodev_valid[4:4];
+	tri1 [ 0:0] iodev_wait_n_i2c;
+
 	wire [31:0] iodev_rdata_esp;
 	wire [ 0:0] iodev_irq_esp;
-	wire [ 0:0] iodev_valid_esp = iodev_valid[4:4];
+	wire [ 0:0] iodev_valid_esp = iodev_valid[5:5];
 	tri1 [ 0:0] iodev_wait_n_esp;
 
 	wire [31:0] iodev_rdata_abc;
 	wire [ 0:0] iodev_irq_abc;
-	wire [ 0:0] iodev_valid_abc = iodev_valid[5:5];
+	wire [ 0:0] iodev_valid_abc = iodev_valid[6:6];
 	tri1 [ 0:0] iodev_wait_n_abc;
 
 	wire [31:0] iodev_rdata_abcmemmap;
@@ -46,8 +51,9 @@
 				4'd1:	 iodev_rdata = iodev_rdata_sysclock;
 				4'd2:	 iodev_rdata = iodev_rdata_console;
 				4'd3:	 iodev_rdata = iodev_rdata_sdcard;
-				4'd4:	 iodev_rdata = iodev_rdata_esp;
-				4'd5:	 iodev_rdata = iodev_rdata_abc;
+				4'd4:	 iodev_rdata = iodev_rdata_i2c;
+				4'd5:	 iodev_rdata = iodev_rdata_esp;
+				4'd6:	 iodev_rdata = iodev_rdata_abc;
 				default: iodev_rdata = 32'hffffffff;
 			endcase
 			default: iodev_rdata = 32'hffffffff;
@@ -57,16 +63,18 @@
 	assign sys_irq[ 3] = iodev_irq_sysclock[0];
 	assign sys_irq[ 4] = iodev_irq_console[0];
 	assign sys_irq[ 5] = iodev_irq_sdcard[0];
-	assign sys_irq[ 6] = iodev_irq_esp[0];
-	assign sys_irq[ 7] = iodev_irq_abc[0];
+	assign sys_irq[ 6] = iodev_irq_i2c[0];
+	assign sys_irq[ 7] = iodev_irq_esp[0];
+	assign sys_irq[ 8] = iodev_irq_abc[0];
 
-	localparam [31:0] irq_edge_mask =  32'h00000088;
-	localparam [31:0] irq_masked    = ~32'h000000ff;
+	localparam [31:0] irq_edge_mask =  32'h00000148;
+	localparam [31:0] irq_masked    = ~32'h000001ff;
 
 	wire iodev_wait_n = (&iodev_wait_n_sys) & 
 		(&iodev_wait_n_sysclock) & 
 		(&iodev_wait_n_console) & 
 		(&iodev_wait_n_sdcard) & 
+		(&iodev_wait_n_i2c) & 
 		(&iodev_wait_n_esp) & 
 		(&iodev_wait_n_abc) & 
 		(&iodev_wait_n_abcmemmap);

fpga/max80.qsf

@@ -219,6 +219,7 @@ set_global_assignment -name VERILOG_INCLUDE_FILE iodevs.vh
 set_global_assignment -name SYSTEMVERILOG_FILE tty.sv
 set_global_assignment -name SYSTEMVERILOG_FILE sdcard.sv
 set_global_assignment -name SYSTEMVERILOG_FILE sysclock.sv
+set_global_assignment -name SYSTEMVERILOG_FILE i2c.sv
 set_global_assignment -name VERILOG_FILE ip/abcmapram.v
 set_global_assignment -name VERILOG_FILE ip/fastmem_ip.v
 set_global_assignment -name SYSTEMVERILOG_FILE fast_mem.sv
@@ -248,4 +249,5 @@ set_global_assignment -name READ_OR_WRITE_IN_BYTE_ADDRESS ON
 set_global_assignment -name POWER_REPORT_POWER_DISSIPATION ON
 set_global_assignment -name POWER_USE_DEVICE_CHARACTERISTICS MAXIMUM
 set_global_assignment -name POWER_USE_TA_VALUE 35
+
 set_instance_assignment -name PARTITION_HIERARCHY root_partition -to | -section_id Top

fpga/max80.sv

@@ -536,10 +536,6 @@ module max80
 		);
 
 
-   // I2C
-   assign i2c_scl = 1'bz;
-   assign i2c_sda = 1'bz;
-
    // GPIO
    assign gpio    = 6'bzzzzzz;
 
@@ -690,7 +686,7 @@ module max80
    wire [ 4:0] sysreg_subreg = cpu_mem_addr[6:2];
    wire [31:0] sysreg = iodev_valid_sys << sysreg_subreg;
    tri1 [31:0] sysreg_rdata[0:31];
-   assign iodev_sys_rdata = sysreg_rdata[sysreg_subreg];
+   assign iodev_rdata_sys = sysreg_rdata[sysreg_subreg];
 
    assign sysreg_rdata[0] = 32'h5058414d;
    assign sysreg_rdata[1] = { 31'b0, rtc_32khz_rework };
@@ -917,6 +913,24 @@ module max80
 
 `endif
 
+   //
+   // I2C bus (RTC and to connector)
+   //
+   i2c i2c (
+	    .rst_n ( rst_n ),
+	    .clk ( sys_clk ),
+
+	    .valid ( iodev_valid_i2c ),
+	    .addr  ( cpu_mem_addr[3:2] ),
+	    .wdata ( cpu_mem_wdata ),
+	    .wstrb ( cpu_mem_wstrb ),
+	    .rdata ( iodev_rdata_i2c ),
+	    .irq ( iodev_irq_i2c ),
+
+	    .i2c_scl ( i2c_scl ),
+	    .i2c_sda ( i2c_sda )
+	    );
+   
    //
    // Registering of I/O data and handling of iodev_mem_ready
    //

fw/Makefile

@@ -37,7 +37,7 @@ boot_width  := 32
 boot_stride := 1
 
 boot.elf: head.o die.o dummy.o irqtable.o irqasm.o sbrk.o hello.o \
-	  console.o sdcard.o fatfs.a
+	  console.o sdcard.o rtc.o fatfs.a
 
 FATFS_C = $(wildcard fatfs/source/*.c)
 FATFS_O = $(FATFS_C:.c=.o)

fw/boot.mif

@@ -9,3532 +9,3611 @@ CONTENT BEGIN
 0002 : 00000197;
 0003 : FF818193;
 0004 : 0001A18B;
-0005 : 06502C23;
-0006 : 4620006F;
+0005 : 08502423;
+0006 : 47A0006F;
 0007 : 00000000;
 0008 : 0001210B;
 0009 : 00000493;
-000A : 00FDF293;
+000A : 0FFDF293;
 000B : 00029663;
-000C : 004DDD93;
-000D : 01048493;
-000E : 003DF293;
+000C : 008DDD93;
+000D : 02048493;
+000E : 00FDF293;
 000F : 00029663;
-0010 : 002DDD93;
-0011 : 00848493;
-0012 : 001DF293;
+0010 : 004DDD93;
+0011 : 01048493;
+0012 : 003DF293;
 0013 : 00029663;
-0014 : 001DDD93;
-0015 : 00448493;
-0016 : 07C4A283;
-0017 : 0024D513;
-0018 : 000280E7;
-0019 : 001DDD93;
-001A : 00448493;
-001B : FA0D9EE3;
-001C : 30200073;
-001D : 00000000;
-001E : 00000000;
-001F : 000004DE;
-0020 : 000004DE;
-0021 : 000004DE;
-0022 : 0000056A;
-0023 : 000004DE;
-0024 : 000004DE;
-0025 : 000004DE;
-0026 : 000004DE;
-0027 : 00003970;
-0028 : 00000001;
-0029 : 00000004;
-002A : 000036D0;
-002B : 00000000;
-002C : 00000000;
-002D : 00000000;
-002E : 00000000;
-002F : 00000000;
+0014 : 002DDD93;
+0015 : 00848493;
+0016 : 001DF293;
+0017 : 00029663;
+0018 : 001DDD93;
+0019 : 00448493;
+001A : 08C4A283;
+001B : 0024D513;
+001C : 000280E7;
+001D : 001DDD93;
+001E : 00448493;
+001F : FA0D96E3;
+0020 : 30200073;
+0021 : 00000000;
+0022 : 00000000;
+0023 : 000004F6;
+0024 : 000004F6;
+0025 : 000004F6;
+0026 : 00000582;
+0027 : 000004F6;
+0028 : 000004F6;
+0029 : 000004F6;
+002A : 000004F6;
+002B : 000004F6;
+002C : 00003AB0;
+002D : 00000001;
+002E : 00000004;
+002F : 0000380C;
 0030 : 00000000;
 0031 : 00000000;
 0032 : 00000000;
 0033 : 00000000;
 0034 : 00000000;
 0035 : 00000000;
-0036 : C686715D;
-0037 : C2A6C4A2;
-0038 : DE4EC0CA;
-0039 : DA56DC52;
-003A : D65ED85A;
-003B : D266D462;
-003C : CE6ED06A;
-003D : 81002483;
-003E : DCED8885;
-003F : C0102473;
-0040 : 07802083;
-0041 : 073776ED;
-0042 : 0A33C000;
-0043 : 4B014014;
-0044 : 80068293;
-0045 : 7FF00813;
-0046 : 631178E1;
-0047 : 00030E37;
-0048 : 00020EB7;
-0049 : 05B36541;
-004A : 863A005B;
-004B : 65630711;
-004C : 5A9332B8;
-004D : E9B3009B;
-004E : 202301DA;
-004F : 0B130136;
-0050 : 12E3200B;
-0051 : 6BF1FEAB;
-0052 : 138B8513;
-0053 : 6C0D2935;
-0054 : 1C8C0513;
-0055 : 0B800D13;
-0056 : 80002423;
-0057 : 202321AD;
-0058 : 2DF3000D;
-0059 : 2E23C010;
-005A : 4F010BB0;
-005B : 078B5FDD;
-005C : 069307FF;
-005D : 428C0A00;
-005E : 0513680D;
-005F : 82930548;
-0060 : A0230015;
-0061 : 29A50056;
-0062 : 05400893;
-0063 : 031A55B3;
-0064 : 05136A0D;
-0065 : 0993068A;
-0066 : 09130B80;
-0067 : 21850BC0;
-0068 : A8000313;
-0069 : 00032E03;
-006A : 001E7E93;
-006B : 2C0E8263;
-006C : 00032503;
-006D : 32000593;
-006E : 00257613;
-006F : 0593E219;
-0070 : 670D0500;
-0071 : 08470513;
-0072 : 6585291D;
-0073 : 89ABD3B7;
-0074 : 1D951BB7;
-0075 : 40000A37;
-0076 : 0B374C21;
-0077 : 84130002;
-0078 : 6D0D1115;
-0079 : DEF38A93;
-007A : C84B8D93;
-007B : 40080CB7;
-007C : 000A2603;
-007D : 00860B63;
-007E : 08631B7D;
-007F : 86A2000C;
-0080 : 051385D2;
-0081 : 1C7D0C4D;
-0082 : 0F332EDD;
-0083 : 0FB30354;
-0084 : 0A1103BA;
-0085 : 03543433;
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+0CD2 : 72726520;
+0CD3 : 32302520;
+0CD4 : 00000A78;
+0CD5 : 00000073;
+0CD6 : 61636473;
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+0CD8 : 64616572;
+0CD9 : 20676E69;
+0CDA : 73206425;
+0CDB : 6F746365;
+0CDC : 20732572;
+0CDD : 25207461;
+0CDE : 6F742075;
+0CDF : 0A702520;
+0CE0 : 00000000;
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+0D0C : 203A6472;
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+0D15 : 65736572;
+0D16 : 000A746E;
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+0D18 : 203A6472;
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+0D1A : 70657220;
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+0D1C : 756E7520;
+0D1D : 6C626173;
+0D1E : 61632065;
+0D1F : 28206472;
+0D20 : 78257830;
+0D21 : 00000A29;
+0D22 : 61636473;
+0D23 : 203A6472;
+0D24 : 444D4341;
+0D25 : 65203134;
+0D26 : 726F7272;
+0D27 : 32302520;
+0D28 : 00000A78;
+0D29 : 61636473;
+0D2A : 203A6472;
+0D2B : 35444D43;
+0D2C : 72652038;
+0D2D : 20726F72;
+0D2E : 78323025;
+0D2F : 0000000A;
+0D30 : 61636473;
+0D31 : 203A6472;
+0D32 : 31444D43;
+0D33 : 72726520;
+0D34 : 2520726F;
+0D35 : 0A783230;
+0D36 : 00000000;
+0D37 : 61636473;
+0D38 : 203A6472;
+0D39 : 31444D43;
+0D3A : 72652036;
+0D3B : 20726F72;
+0D3C : 78323025;
+0D3D : 0000000A;
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+0D45 : 63202C64;
+0D46 : 63617061;
+0D47 : 20797469;
+0D48 : 73207525;
+0D49 : 6F746365;
+0D4A : 000A7372;
+0D4B : 61636473;
+0D4C : 203A6472;
+0D4D : 76206F6E;
+0D4E : 6D756C6F;
+0D4F : 6F662065;
+0D50 : 0A646E75;
+0D51 : 00000000;
+0D52 : 61636473;
+0D53 : 203A6472;
+0D54 : 756C6F76;
+0D55 : 6620656D;
+0D56 : 646E756F;
+0D57 : 616C202C;
+0D58 : 206C6562;
+0D59 : 22732522;
+0D5A : 6F76202C;
+0D5B : 2064696C;
+0D5C : 78383025;
+0D5D : 0000000A;
+0D5E : 61636473;
+0D5F : 203A6472;
+0D60 : 252F7525;
+0D61 : 6C632075;
+0D62 : 65747375;
+0D63 : 66207372;
+0D64 : 2C656572;
+0D65 : 756C6320;
+0D66 : 72657473;
+0D67 : 203D2073;
+0D68 : 62207525;
+0D69 : 73657479;
+0D6A : 0000000A;
+0D6B : 6E6B6E75;
+0D6C : 006E776F;
+0D6D : 4D2F4453;
+0D6E : 0000434D;
+0D6F : 43484453;
+0D70 : 5844532F;
+0D71 : 4D652F43;
+0D72 : 0000434D;
+0D73 : 000035AC;
+0D74 : 000035B4;
+0D75 : 000035BC;
+0D76 : 52206F4E;
+0D77 : 64204354;
+0D78 : 63657465;
+0D79 : 20646574;
+0D7A : 49207461;
+0D7B : 61204332;
+0D7C : 65726464;
+0D7D : 30207373;
+0D7E : 32302578;
+0D7F : 00000A78;
+0D80 : 20435452;
+0D81 : 69676572;
+0D82 : 72657473;
+0D83 : 6E6F6320;
+0D84 : 746E6574;
+0D85 : 00000A3A;
+0D86 : 78323025;
+0D87 : 00000020;
+0D88 : 459076EB;
+0D89 : 54414658;
+0D8A : 00202020;
+0D8B : 33544146;
+0D8C : 20202032;
+0D8D : 00000000;
+0D8E : 07050301;
+0D8F : 12100E09;
+0D90 : 1C181614;
+0D91 : 0000001E;
+0D92 : 00FC00C7;
+0D93 : 00E200E9;
+0D94 : 00E000E4;
+0D95 : 00E700E5;
+0D96 : 00EB00EA;
+0D97 : 00EF00E8;
+0D98 : 00EC00EE;
+0D99 : 00C500C4;
+0D9A : 00E600C9;
+0D9B : 00F400C6;
+0D9C : 00F200F6;
+0D9D : 00F900FB;
+0D9E : 00D600FF;
+0D9F : 00A200DC;
+0DA0 : 00A500A3;
+0DA1 : 019220A7;
+0DA2 : 00ED00E1;
+0DA3 : 00FA00F3;
+0DA4 : 00D100F1;
+0DA5 : 00BA00AA;
+0DA6 : 231000BF;
+0DA7 : 00BD00AC;
+0DA8 : 00A100BC;
+0DA9 : 00BB00AB;
+0DAA : 25922591;
+0DAB : 25022593;
+0DAC : 25612524;
+0DAD : 25562562;
+0DAE : 25632555;
+0DAF : 25572551;
+0DB0 : 255C255D;
+0DB1 : 2510255B;
+0DB2 : 25342514;
+0DB3 : 251C252C;
+0DB4 : 253C2500;
+0DB5 : 255F255E;
+0DB6 : 2554255A;
+0DB7 : 25662569;
+0DB8 : 25502560;
+0DB9 : 2567256C;
+0DBA : 25642568;
+0DBB : 25592565;
+0DBC : 25522558;
+0DBD : 256B2553;
+0DBE : 2518256A;
+0DBF : 2588250C;
+0DC0 : 258C2584;
+0DC1 : 25802590;
+0DC2 : 00DF03B1;
+0DC3 : 03C00393;
+0DC4 : 03C303A3;
+0DC5 : 03C400B5;
+0DC6 : 039803A6;
+0DC7 : 03B403A9;
+0DC8 : 03C6221E;
+0DC9 : 222903B5;
+0DCA : 00B12261;
+0DCB : 22642265;
+0DCC : 23212320;
+0DCD : 224800F7;
+0DCE : 221900B0;
+0DCF : 221A00B7;
+0DD0 : 00B2207F;
+0DD1 : 00A025A0;
+0DD2 : 2B302D23;
+0DD3 : 00000020;
+0DD4 : 004C6C68;
+0DD5 : 45676665;
+0DD6 : 00004746;
+0DD7 : 33323130;
+0DD8 : 37363534;
+0DD9 : 42413938;
+0DDA : 46454443;
+0DDB : 00000000;
+0DDC : 33323130;
+0DDD : 37363534;
+0DDE : 62613938;
+0DDF : 66656463;
+0DE0 : 00000000;
+0DE1 : 00002C0A;
+0DE2 : 00002C20;
+0DE3 : 00002BDE;
+0DE4 : 00002BDE;
+0DE5 : 00002BDE;
+0DE6 : 00002BDE;
+0DE7 : 00002C20;
+0DE8 : 00002BDE;
+0DE9 : 00002BDE;
+0DEA : 00002BDE;
+0DEB : 00002BDE;
+0DEC : 00002DAE;
+0DED : 00002C70;
+0DEE : 00002D40;
+0DEF : 00002BDE;
+0DF0 : 00002BDE;
+0DF1 : 00002DEA;
+0DF2 : 00002BDE;
+0DF3 : 00002C70;
+0DF4 : 00002BDE;
+0DF5 : 00002BDE;
+0DF6 : 00002D4C;
+0DF7 : 00000001;
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+0E17 : 00000000;
+0E18 : 00000000;
+0E19 : 00000000;
+0E1A : 00000000;
+[0E1B..1FFF] : 00;
 END;

fw/fw.h

@@ -20,4 +20,6 @@ extern void *_sbrk(size_t);
 
 extern int disk_init(void);
 
+extern void read_rtc(void);
+
 #endif /* FW_H */

fw/hello.c

@@ -177,6 +177,8 @@ static void init(void)
     timer_irq_count = 0;
     timer_irq_start = rdtime();
     unmask_irq(SYSCLOCK_IRQ);
+
+    read_rtc();
 }
 
 void main(void)

fw/io.h

@@ -115,6 +115,9 @@ static inline uint8_t sd_crc16_wr(void)
 {
     return SDCARD_CRC16_WR;
 }
-
+static inline void i2c_set_speed(unsigned int khz)
+{
+    I2C_DIVISOR = ((CPU_HZ/4000)-1)/khz;
+}
 
 #endif /* IO_H */

fw/ioregs.h

@@ -79,6 +79,14 @@
 #define SD_25MHZ	2	/* Really 21 MHz */
 #define SD_50MHZ	1	/* Really 42 MHz */
 
+#define I2C_WDATA		IODEVL(I2C,0)
+#define I2C_RDATA		IODEVL(I2C,1)
+#define I2C_DIVISOR		IODEVL(I2C,2)
+#define I2C_BUSY		1
+#define I2C_SR			2
+#define I2C_P			4
+#define I2C_NAK			0x80
+
 #define SYSCLOCK_DATETIME	IODEVL(SYSCLOCK,0)
 #define SYSCLOCK_TICK		IODEVL(SYSCLOCK,1)
 #define SYSCLOCK_TICK_HOLD	IODEVH0(SYSCLOCK,1)

fw/rtc.c

@@ -0,0 +1,77 @@
+/*
+ * Read/write DS3231M RTC
+ */
+
+#include "fw.h"
+#include "console.h"
+#include "io.h"
+
+static inline uint32_t i2c_wait(void)
+{
+    uint32_t rdata;
+
+    while ((rdata = I2C_RDATA) & I2C_BUSY)
+	pause();
+
+    return rdata;
+}
+
+static void i2c_send(uint8_t byte, uint8_t ctl)
+{
+    i2c_wait();
+
+    I2C_WDATA = (byte << 8) | I2C_NAK | ctl;
+}
+
+static bool i2c_acked(void)
+{
+    return !(i2c_wait() & I2C_NAK);
+}
+
+static int i2c_recv(uint8_t ctl)
+{
+    uint32_t rdata;
+    
+    i2c_wait();
+
+    I2C_WDATA = (~0xff) | ctl;
+
+    rdata = i2c_wait();
+    return rdata >> 8;
+}
+
+#define RTC_REGS 19
+#define RTC_ADDR 0x68
+#define RTC_WCMD ((RTC_ADDR << 1)+0)
+#define RTC_RCMD ((RTC_ADDR << 1)+1)
+
+void read_rtc(void)
+{
+    uint8_t rtc_regs[RTC_REGS];
+    int i;
+    
+    i2c_set_speed(400);
+    
+    /* Synchronize I2C */
+    i2c_send(0xff, I2C_P);
+    
+    i2c_send(RTC_WCMD, 0);
+
+    if (!i2c_acked()) {
+	con_printf("No RTC detected at I2C address 0x%02x\n", RTC_ADDR);
+	i2c_send(0xff, I2C_P);
+	return;
+    }
+    
+    i2c_send(0, I2C_SR);
+    i2c_send(RTC_RCMD, 0);
+
+    con_printf("RTC register content:\n");
+    for (i = 0; i < RTC_REGS-1; i++) {
+	rtc_regs[i] = i2c_recv(0);
+	con_printf("%02x ", rtc_regs[i]);
+    }
+
+    rtc_regs[i] = i2c_recv(I2C_NAK | I2C_P);
+    con_printf("%02x\n", rtc_regs[i]);
+}

iodevs.conf

@@ -18,6 +18,7 @@ our @iodevs = (
     { -name => 'sysclock',  -irq => 'e' },
     { -name => 'console',   -irq => 'l' },
     { -name => 'sdcard',    -irq => 'l' },
+    { -name => 'i2c',       -irq => 'e' },
     { -name => 'esp',       -irq => 'l' },
     { -name => 'abc',       -irq => 'e' },
     { -name => 'abcmemmap', -xdev => 1 },