| 123456789101112131415161718192021222324252627282930313233343536373839404142434445464748495051525354555657585960616263646566676869707172737475767778798081828384858687888990919293949596979899100101102103104105106107108109110111112113114115116117118119120121122123124125126127128129130131132133134135136137138139140141142143144145146147148149150151152153154155156157158159160161162163164165166167168169170171172173174175176177178179180181182183184185186187188189190191192193194195196197198199200201202203204205206207208209210211212213214215216217218219220221222223224225226227228229230231232233234235236237238239240241242243244245246247248249250251252253254255256257258259260261262263264265266267268269270271272273274275276277278279280281282283284285286287288289290291292293294295296297298299300301302303304305306307308309310311312313314315316317318319320321322323324325326327 |  -- Copyright (C) 2021  Intel Corporation. All rights reserved. -- Your use of Intel Corporation's design tools, logic functions  -- and other software and tools, and any partner logic  -- functions, and any output files from any of the foregoing  -- (including device programming or simulation files), and any  -- associated documentation or information are expressly subject  -- to the terms and conditions of the Intel Program License  -- Subscription Agreement, the Intel Quartus Prime License Agreement, -- the Intel FPGA IP License Agreement, or other applicable license -- agreement, including, without limitation, that your use is for -- the sole purpose of programming logic devices manufactured by -- Intel and sold by Intel or its authorized distributors.  Please -- refer to the applicable agreement for further details, at -- https://fpgasoftware.intel.com/eula. --  -- This is a Quartus Prime output file. It is for reporting purposes only, and is -- not intended for use as a Quartus Prime input file. This file cannot be used -- to make Quartus Prime pin assignments - for instructions on how to make pin -- assignments, please see Quartus Prime help. --------------------------------------------------------------------------------- --------------------------------------------------------------------------------- -- NC            : No Connect. This pin has no internal connection to the device. -- DNU           : Do Not Use. This pin MUST NOT be connected. -- VCCINT        : Dedicated power pin, which MUST be connected to VCC  (1.2V). -- VCCIO         : Dedicated power pin, which MUST be connected to VCC --                 of its bank. --                  Bank 1:       3.3V --                  Bank 2:       3.3V --                  Bank 3:       3.3V --                  Bank 4:       3.3V --                  Bank 5:       2.5V --                  Bank 6:       3.3V --                  Bank 7:       3.3V --                  Bank 8:       3.3V -- GND           : Dedicated ground pin. Dedicated GND pins MUST be connected to GND. --                  It can also be used to report unused dedicated pins. The connection --                  on the board for unused dedicated pins depends on whether this will --                  be used in a future design. One example is device migration. When --                  using device migration, refer to the device pin-tables. If it is a --                  GND pin in the pin table or if it will not be used in a future design --                  for another purpose the it MUST be connected to GND. If it is an unused --                  dedicated pin, then it can be connected to a valid signal on the board --                  (low, high, or toggling) if that signal is required for a different --                  revision of the design. -- GND+          : Unused input pin. It can also be used to report unused dual-purpose pins. --                  This pin should be connected to GND. It may also be connected  to a --                  valid signal  on the board  (low, high, or toggling)  if that signal --                  is required for a different revision of the design. -- GND*          : Unused  I/O  pin. Connect each pin marked GND* directly to GND --                  or leave it unconnected. -- RESERVED      : Unused I/O pin, which MUST be left unconnected. -- RESERVED_INPUT    : Pin is tri-stated and should be connected to the board. -- RESERVED_INPUT_WITH_WEAK_PULLUP    : Pin is tri-stated with internal weak pull-up resistor. -- RESERVED_INPUT_WITH_BUS_HOLD       : Pin is tri-stated with bus-hold circuitry. -- RESERVED_OUTPUT_DRIVEN_HIGH        : Pin is output driven high. --------------------------------------------------------------------------------- --------------------------------------------------------------------------------- -- Pin directions (input, output or bidir) are based on device operating in user mode. ---------------------------------------------------------------------------------Quartus Prime Version 21.1.0 Build 842 10/21/2021 SJ Lite EditionCHIP  "bypass"  ASSIGNED TO AN: EP4CE15F17C8Pin Name/Usage               : Location  : Dir.   : I/O Standard      : Voltage : I/O Bank  : User Assignment-------------------------------------------------------------------------------------------------------------VCCIO8                       : A1        : power  :                   : 3.3V    : 8         :                abc_int800_x                 : A2        : output : 3.3-V LVTTL       :         : 8         : Y              abc_nmi_x                    : A3        : output : 3.3-V LVTTL       :         : 8         : Y              RESERVED_INPUT_WITH_WEAK_PULLUP : A4        :        :                   :         : 8         :                RESERVED_INPUT_WITH_WEAK_PULLUP : A5        :        :                   :         : 8         :                RESERVED_INPUT_WITH_WEAK_PULLUP : A6        :        :                   :         : 8         :                RESERVED_INPUT_WITH_WEAK_PULLUP : A7        :        :                   :         : 8         :                GND+                         : A8        :        :                   :         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