max80: fix timing bug that affected code execution from SDRAM

Instruction fetches are pickier about signal timing than ordinary data
fetches, so the sdram state machine broke because timing improvements
ended up leaving the valid bit on too long. Fix that.

v2 now boots fully.

fpga/max80.qpf

@@ -19,14 +19,14 @@
 #
 # Quartus Prime
 # Version 21.1.0 Build 842 10/21/2021 SJ Lite Edition
-# Date created = 03:59:44  February 02, 2022
+# Date created = 04:05:18  February 02, 2022
 #
 # -------------------------------------------------------------------------- #
 
 QUARTUS_VERSION = "21.1"
-DATE = "03:59:44  February 02, 2022"
+DATE = "04:05:18  February 02, 2022"
 
 # Revisions
 
-PROJECT_REVISION = "v1"
 PROJECT_REVISION = "v2"
+PROJECT_REVISION = "v1"

fpga/max80.sv

@@ -278,7 +278,6 @@ module max80
    wire [31:0]                cpu_mem_addr;
    wire [31:0]                cpu_mem_wdata;
    reg  [31:0]		      cpu_mem_rdata;
-   reg			      cpu_mem_ready;
 
    wire                       cpu_la_read;
    wire                       cpu_la_write;
@@ -286,19 +285,19 @@ module max80
    wire [31:0]		      cpu_la_wdata;
    wire [ 3:0]		      cpu_la_wstrb;
 
-   // cpu_mem_valid by address quadrant
-   wire [3:0]		      cpu_la_quad;
-   reg [3:0]		      cpu_mem_quad;
-
-   assign cpu_la_quad = 1'b1 << cpu_la_addr[31:30];
+   // cpu_mem_valid by address quadrant, using a bit of lookahead
+   // decoding for speed.
+   reg  [3:0]		      mem_quad;
 
    always @(negedge rst_n or posedge sys_clk)
      if (~rst_n)
-       cpu_mem_quad <= 4'b0;
-     else if (cpu_la_read|cpu_la_write)
-       cpu_mem_quad <= cpu_la_quad;
-     else if (~cpu_mem_valid)
-       cpu_mem_quad <= 4'b0;
+       mem_quad <= 4'b0;
+     else if (cpu_mem_valid)
+       mem_quad <= 1'b1 << cpu_mem_addr[31:30];
+     else
+       mem_quad <= 1'b1 << cpu_la_addr[31:30];
+
+   wire [3:0] cpu_mem_quad = cpu_mem_valid ? mem_quad : 4'b0;
 
    // I/O device map from iodevs.conf
    wire        iodev_mem_valid = cpu_mem_quad[3];
@@ -540,11 +539,11 @@ module max80
    // accesses...)
    reg	       iodev_mem_ready;
 
-   assign cpu_mem_ready = cpu_mem_quad[0] |
-			  (cpu_mem_quad[1] & sdram_mem_ready) |
-			  cpu_mem_quad[2] |
-			  (cpu_mem_quad[3] & iodev_mem_ready);
-
+   assign cpu_mem_ready =
+			 (cpu_mem_quad[0] & 1'b1) |
+			 (cpu_mem_quad[1] & sdram_mem_ready) |
+			 (cpu_mem_quad[2] & 1'b1) |
+			 (cpu_mem_quad[3] & iodev_mem_ready);
    //
    // Fast memory. This runs on the SDRAM clock, i.e. 2x the speed
    // of the CPU. The .bits parameter gives the number of dwords
@@ -556,8 +555,8 @@ module max80
    fast_mem(
 	    .rst_n ( rst_n ),
 	    .clk   ( sys_clk ),
-	    .read  ( cpu_la_read  & cpu_la_quad[0] ),
-	    .write ( cpu_la_write & cpu_la_quad[0] ),
+	    .read  ( cpu_la_read  & cpu_la_addr[31:30] == 2'b00 ),
+	    .write ( cpu_la_write & cpu_la_addr[31:30] == 2'b00 ),
 	    .wstrb ( cpu_la_wstrb ),
 	    .addr  ( cpu_la_addr[14:2] ),
 	    .wdata ( cpu_la_wdata ),

fpga/output/sram.mif

@@ -6,7 +6,7 @@ DATA_RADIX = HEX;
 CONTENT BEGIN
 0000 : 00000000;
 0001 : 00000000;
-0002 : DA68A8E8;
+0002 : E3ABE76A;
 0003 : 00100000;
 0004 : C0102473;
 0005 : 00008137;
@@ -15,7 +15,7 @@ CONTENT BEGIN
 0008 : 0001210B;
 0009 : 008DF413;
 000A : 00040863;
-000B : 595000EF;
+000B : 3CF000EF;
 000C : 408D8DB3;
 000D : 060D8063;
 000E : 00000493;
@@ -48,26 +48,26 @@ CONTENT BEGIN
 0029 : 0000250B;
 002A : 0005B00B;
 002B : 00000000;
-002C : 29F0006F;
+002C : 0DB0006F;
 002D : 5880006F;
 002E : 5780006F;
-002F : 5050006F;
+002F : 33F0006F;
 0030 : 5880006F;
-0031 : 28B0006F;
-0032 : 2550106F;
-0033 : 2830006F;
-0034 : 27F0006F;
-0035 : 2C30006F;
-0036 : 2770006F;
-0037 : 2730006F;
-0038 : 26F0006F;
-0039 : 26B0006F;
+0031 : 0C70006F;
+0032 : 08F0106F;
+0033 : 0BF0006F;
+0034 : 0BB0006F;
+0035 : 0FF0006F;
+0036 : 0B30006F;
+0037 : 0AF0006F;
+0038 : 0AB0006F;
+0039 : 0A70006F;
 003A : 00000000;
 003B : 7C5C2D2F;
-003C : 4101D2A0;
+003C : 4101D4A0;
 003D : FFFFFFFF;
 003E : FFFFFFFF;
-003F : 00001D04;
+003F : 00001B70;
 0040 : 00000040;
 0041 : 00000000;
 0042 : 00000000;
@@ -198,29 +198,29 @@ CONTENT BEGIN
 00BF : 16204283;
 00C0 : 00028663;
 00C1 : 40007097;
-00C2 : D46080E7;
+00C2 : F9E080E7;
 00C3 : 400074B7;
 00C4 : 40007937;
 00C5 : 5AFD4981;
-00C6 : 09C48493;
-00C7 : 10690913;
+00C6 : 2F448493;
+00C7 : 36B90913;
 00C8 : 40007A37;
 00C9 : 0750008B;
 00CA : 0810878B;
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 00CC : 00030663;
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+00CE : 68E080E7;
+00CF : 435000EF;
 00D0 : 89C02403;
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 00DB : D3468693;
@@ -328,9 +328,9 @@ CONTENT BEGIN
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+0146 : 96840413;
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@@ -401,10 +401,10 @@ CONTENT BEGIN
 018A : 00239850;
 018B : B7A19930;
 018C : 11416509;
-018D : B5650513;
+018D : 98E50513;
 018E : 3D5DC606;
 018F : 11416509;
-0190 : B6150513;
+0190 : 99950513;
 0191 : 356DC606;
 0192 : 12400293;
 0193 : 0002A783;
@@ -423,1478 +423,1377 @@ CONTENT BEGIN
 01A0 : CE061101;
 01A1 : CA26CC22;
 01A2 : C64EC84A;
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-01A7 : 0610078B;
-01A8 : 02936409;
-01A9 : 8313B304;
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-01AC : 43834535;
-01AD : 03050003;
-01AE : 1A039C63;
-01AF : 85136489;
-01B0 : 47A9D724;
-01B1 : 45834EB5;
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-01B3 : 1A059963;
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-01B5 : 46A998C0;
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+0667 : 64696C61;
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+066D : 6F6C6C65;
+066E : 6F57202C;
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+0670 : 2A2A2A20;
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+0672 : 66203038;
+0673 : 776D7269;
+0674 : 20657261;
+0675 : 706D6F63;
+0676 : 64656C69;
+0677 : 3A6E6F20;
+0678 : 44530020;
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+067C : 75736B63;
+067D : 00203A6D;
+067E : 70786520;
+067F : 65746365;
+0680 : 42002064;
+0681 : 20737469;
+0682 : 61776C61;
+0683 : 73207379;
+0684 : 202C7465;
+0685 : 61656C63;
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+0688 : 74616420;
+0689 : 00203A61;
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+068B : 6572204D;
+068C : 772F6461;
+068D : 65746972;
+068E : 72726520;
+068F : 000A726F;
+0690 : 41524453;
+0691 : 622E204D;
+0692 : 69207373;
+0693 : 6F6E2073;
+0694 : 657A2074;
+0695 : 0A216F72;
+0696 : 69615700;
+0697 : 676E6974;
+0698 : 73203520;
+0699 : 726F6620;
+069A : 73657420;
+069B : 676E6974;
+069C : 002E2E2E;
+069D : 41524453;
+069E : 756A204D;
+069F : 7420706D;
+06A0 : 3A747365;
+06A1 : 754A0A00;
+06A2 : 6E69706D;
+06A3 : 6F742067;
+06A4 : 52445320;
+06A5 : 2E2E4D41;
+06A6 : 6200202E;
+06A7 : 206B6361;
+06A8 : 53206E69;
+06A9 : 2E4D4152;
+06AA : 4F52000A;
+06AB : 6573204D;
+06AC : 6C616972;
+06AD : 0000203A;
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+06AF : 00000000;
+06B0 : 00000000;
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+06B2 : 00000000;
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+06BF : 00007FBF;
+06C0 : 00000000;
+06C1 : D3030300;
+06C2 : 000016F0;
+06C3 : 00000000;
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+06CD : 00000000;
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+06D0 : 0000FFFF;
+06D1 : 00000000;
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+06EC : 00000000;
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+06EF : 00000000;
+06F0 : 00000000;
+06F1 : 00000000;
+06F2 : 00000000;
+06F3 : 00000000;
+06F4 : 6362612F;
+06F5 : 6B736964;
+06F6 : 3030382E;
+06F7 : 6557002F;
+06F8 : 65462064;
+06F9 : 32202062;
+06FA : 3A343020;
+06FB : 323A3833;
+06FC : 53502038;
+06FD : 30322054;
+06FE : 003232;
+[06FF..1FFF] : 00;
 END;

rv32/checksum.h

@@ -1,4 +1,4 @@
 #ifndef CHECKSUM_H
 #define CHECKSUM_H
-#define SDRAM_SUM 0xda68a8e8
+#define SDRAM_SUM 0xe3abe76a
 #endif

rv32/system.c

@@ -81,6 +81,7 @@ IRQHANDLER(sysclock,0)
 }
 
 static void late_init(void);
+static void hello_sdram(void);
 
 static const volatile __dram_data
 uint32_t test_data[2] = { 0x01234567, 0x89abcdef };
@@ -183,12 +184,29 @@ void __hot init(void)
     con_flush();
 #endif
 
+    if ( MINITESTS ) {
+	const volatile uint32_t *p = (const volatile uint32_t *)hello_sdram;
+	con_puts(hotstr("SDRAM jump test:"));
+	for (int i = 0; i < 4; i++) {
+	    con_putc(' ');
+	    con_print_hex(p[i]);
+	}
+	con_puts(hotstr("\nJumping to SDRAM... "));
+	hello_sdram();
+	con_puts(hotstr("back in SRAM.\n"));
+    }
+
     late_init();
 }
 
+static void __noinline hello_sdram(void)
+{
+    con_puts("in SDRAM... ");
+}
+
 volatile uint32_t __dram_bss test_dram[8];
 
-static void __hot late_init(void)
+static void __noinline late_init(void)
 {
     /* This needs to be done as early as possible!!! */
     con_puts("Running abc_init_memmap: ");