tty: add status register and irq support; clean up iodev map

Add a status register to the tty to avoid FIFO overflow and be able to
determine when the transmitter is truly empty. Add support for the
status bits to generate interrupts.

fpga/max80.sv

@@ -160,7 +160,7 @@ module max80 (
        end
      else
        begin
-	  reset_cmd_q <= reset_cmd_q | (rst_n & reset_cmd);
+	  reset_cmd_q <= rst_n & (reset_cmd_q | reset_cmd);
 	  if (~rst_n)
 	    { rst_n, rst_ctr } <= rst_ctr + 1'b1;
        end
@@ -386,8 +386,22 @@ module max80 (
 
    // Decode for small devices; use address space within range of
    // negative offsets from the zero register [-1K,0)
+   //
+   // Device map:
+   //  0 - LED
+   //  1 - Reset
+   //  2 - SPI->SDRAM downloader
+   //  3 - Serial port
+   //
+   // A device has IRQ (devno)+16 if it needs an interrupt.
+   //
+
    wire [15:0] iodev = cpu_mem_quad[3] << cpu_mem_addr[9:6];
+   tri0 [15:0] iodev_irq;	// tri0: if nothing is driving, value is 0
 
+   //
+   // SDRAM
+   //
    wire [31:0] sdram_rd;
    wire        sdram_rack;
    wire        sdram_rready;
@@ -489,6 +503,7 @@ module max80 (
 	      .REGS_INIT_ZERO ( 1 ),
 	      .STACKADDR ( 32'h4 << cpu_fast_mem_bits )
 	      )
+
    cpu (
 	.clk ( sys_clk ),
 	.resetn ( rst_n ),
@@ -508,7 +523,7 @@ module max80 (
 	.mem_la_addr  ( cpu_la_addr ),
 	.mem_la_wstrb ( cpu_la_wstrb ),
 
-	.irq ( 0 ),
+	.irq ( { iodev_irq, 16'b0 } ),
 	.eoi ( )
 	);
 
@@ -572,7 +587,7 @@ module max80 (
      endcase
 
    // Hard system reset under program control
-   assign reset_cmd = rst_n & iodev[15] & cpu_mem_wstrb[0] & cpu_mem_wdata[0];
+   assign reset_cmd = rst_n & iodev[1] & cpu_mem_wstrb[0] & cpu_mem_wdata[0];
 
    // LED indication from the CPU
    reg [2:0]   led_q;
@@ -627,16 +642,19 @@ module max80 (
    wire        tty_data_in;	// Input data
    wire        tty_cts_out;	// Assert CTS# externally
    wire        tty_rts_in;	// RTS# received from outside
+   wire [31:0] tty_rdata;
 
    assign tty_cts_out  = 1'b0;	// Assert CTS#
    tty tty (
 	    .rst_n ( rst_n ),
 	    .clk ( sys_clk ),
 
-	    .valid ( iodev[1] ),
+	    .valid ( iodev[3] ),
 	    .wstrb ( cpu_mem_wstrb ),
 	    .wdata ( cpu_mem_wdata ),
-	    .addr ( cpu_mem_addr[2] ),
+	    .rdata ( tty_rdata ),
+	    .addr ( cpu_mem_addr[3:2] ),
+	    .irq  ( iodev_irq[3] ),
 
 	    .tty_txd ( tty_data_out ) // DTE -> DCE
 	    );
@@ -670,7 +688,9 @@ module max80 (
    //
    always @(*)
      case ( cpu_mem_addr[9:6] )
+       4'h0:    iodev_rdata = { 29'b0, led_q };
        4'h2:    iodev_rdata = { 31'b0, rom_done_q };
+       4'h3:	iodev_rdata = tty_rdata;
        default: iodev_rdata = 32'hffff_ffff;
      endcase
    

fpga/output_files/max80.map

@@ -11,7 +11,7 @@ Quad-Serial configuration device dummy clock cycle: 8
 
 Notes:
 
-- Data checksum for this conversion is 0xF3795A1E
+- Data checksum for this conversion is 0xF385C8C0
 
 - All the addresses in this file are byte addresses
 

fpga/tty.sv

@@ -5,20 +5,30 @@
 // Currently only transmit is supported, 8-N-1, at a fixed speed.
 // The baud rate is tty_clk/((divisor+1)*16).
 //
-// Currently there is no overrun checking or interrupt support, but that
-// can come later. A large FIFO makes that less of an issue anyway...
+// The registers are as follows:
 //
+// 0 - WO - data register (will be RW)
+// 1 - RW - baud rate register (binary fraction of TTY_CLK/16 - 1)
+// 2 - RO - status register
+//          0 - transmitter idle (FIFO and shift register empty)
+//          1 - transmit FIFO 3/4 empty
+//	    2 - transmit FIFO 1/2 empty
+//          3 - transmit FIFO 1/2 full (inverse of bit 2)
+//          4 - transmit FIFO 3/4 full
+// 3 - RW - interrupt enable register (status register mask)
 
 module tty (
-	    input 	 rst_n,
-	    input 	 clk,
+	    input 	      rst_n,
+	    input 	      clk,
 
-	    input 	 valid,
-	    input [3:0]  wstrb,
-	    input [31:0] wdata,
-	    input [0:0]  addr,
+	    input 	      valid,
+	    input [3:0]       wstrb,
+	    input [31:0]      wdata,
+	    input [1:0]       addr,
+	    output reg [31:0] rdata,
+	    output reg	      irq,
 
-	    output 	 tty_txd
+	    output 	      tty_txd
 	    );
 
    `include "functions.sv"	// For ModelSim
@@ -53,6 +63,7 @@ module tty (
    wire tx_wrreq;
    wire tx_rdempty;
    wire [7:0] tx_data;
+   wire [8:0] tx_usedw;
    
    fifo txfifo (
 		.aclr ( ~rst_n ),
@@ -64,30 +75,9 @@ module tty (
 		.empty ( tx_rdempty ),
 		.full ( ),
 		.q ( tx_data ),
-		.usedw ( )
+		.usedw ( tx_usedw )
 		);
 
-   //
-   // CPU -> transmitter data. No wait state is needed nor expected.
-   //
-
-   // Data mask (if/when needed)
-   wire [31:0] wmask = {{8{wstrb[3]}}, {8{wstrb[2]}},
-			{8{wstrb[1]}}, {8{wstrb[0]}}};
-
-   // Data (FIFO) register; normally addressed as byte
-   // Protect against long pulses (edge detect)
-   reg old_wstrb;
-   always @(posedge clk)
-     old_wstrb <= wstrb[0];
-
-   assign tx_wrreq = valid & wstrb[0] & ~old_wstrb & (addr == 0);
-
-   // Divisor register
-   always @(posedge clk)
-     if (wstrb[0] & valid & (addr == 1))
-       divisor <= wdata[NCO_BITS-1:0] & wmask;
-
    //
    // Transmitter
    //
@@ -135,4 +125,63 @@ module tty (
 		 end // if (tx_phase == 4'hF)
 	    end // if ( tty_clk_en )
        end // else: !if(~rst_n)
+
+   //
+   // CPU interface
+   //
+
+   // Data (FIFO) register; normally addressed as byte
+   // Protect against long pulses (edge detect)
+   reg old_wstrb;
+   always @(posedge clk)
+     old_wstrb <= wstrb[0];
+
+   assign tx_wrreq = valid & wstrb[0] & ~old_wstrb & (addr == 2'b00);
+
+   // Status register definition
+   localparam status_bits = 5;
+   
+   wire [status_bits-1:0] status;
+
+   assign status[0] = tx_rdempty & (tx_bits == 4'd0);
+   assign status[1] = tx_usedw[8:7] == 2'b00;
+   assign status[2] = ~tx_usedw[8];
+   assign status[3] = tx_usedw[8];
+   assign status[4] = tx_usedw[8:7] == 2'b11;
+   
+   reg [status_bits-1:0]   irq_en;
+
+   //
+   // Control register writes.
+   // Only full word writes are supported.
+   //
+   always @(negedge rst_n or posedge clk)
+     if (~rst_n)
+       begin
+	  irq_en <= 5'b0;
+       end
+     else if (valid & (&wstrb))
+       case (addr)
+	 2'b01: divisor <= wdata[NCO_BITS-1:0];
+	 2'b11: irq_en  <= wdata[status_bits-1:0];
+       endcase // case (addr)
+
+   // Read MUX
+   always @(*)
+     begin
+	rdata = 32'b0;
+	case (addr)
+	  2'b01: rdata = divisor;
+	  2'b10: rdata = status;
+	  2'b11: rdata = irq_en;
+	endcase // case (addr)
+     end
+
+   // Interrupt
+   always @(negedge rst_n or posedge clk)
+     if (~rst_n)
+       irq <= 1'b0;
+     else
+       irq <= |(status & irq_en);
+   
 endmodule // tty

fw/boot.mif

@@ -5,7 +5,7 @@ ADDRESS_RADIX = HEX;
 DATA_RADIX = HEX;
 CONTENT BEGIN
 000 : 00002137;
-001 : 3300006F;
+001 : 31A0006F;
 002 : 00000000;
 003 : 00000000;
 004 : C0067139;
@@ -18,7 +18,7 @@ CONTENT BEGIN
 00B : DC42DA3E;
 00C : 850BDE46;
 00D : 00EF0000;
-00E : 408237A0;
+00E : 40823680;
 00F : 43224292;
 010 : 4E4243B2;
 011 : 4F624ED2;
@@ -36,25 +36,25 @@ CONTENT BEGIN
 01D : D05AD256;
 01E : CC62CE5E;
 01F : C86ACA66;
-020 : 2645C66E;
+020 : 2679C66E;
 021 : C0000023;
 022 : C8002783;
 023 : 2473DFF5;
 024 : 6085C010;
-025 : 02008513;
-026 : 83132E75;
+025 : 15008513;
+026 : 83132E5D;
 027 : 25838601;
 028 : 63850003;
-029 : F2C38513;
+029 : 05C38513;
 02A : 00158713;
 02B : 00E32023;
-02C : 05932EE9;
+02C : 05932ED1;
 02D : 55B30540;
 02E : 648502B4;
-02F : F4048513;
+02F : 07048513;
 030 : 40000D37;
 031 : 40080A37;
-032 : 660526C9;
+032 : 66052E75;
 033 : 89ABD6B7;
 034 : 1D951837;
 035 : 11160C93;
@@ -72,1055 +72,1131 @@ CONTENT BEGIN
 041 : FF4D10E3;
 042 : 06376D85;
 043 : 85130002;
-044 : 2EA5F5CD;
-045 : 000A4E37;
-046 : 40000437;
-047 : 09136A85;
-048 : 6A410FFE;
-049 : 400809B7;
-04A : 0B1384A2;
-04B : 8EA60204;
-04C : 0004D583;
-04D : 002ED603;
-04E : 85130491;
-04F : 26B1F70A;
-050 : FF6497E3;
-051 : 2CF54529;
-052 : C0102F73;
-053 : C0102FF3;
-054 : 41EF8533;
-055 : FEA97CE3;
-056 : 17E39452;
-057 : 2B73FD34;
-058 : 8793C010;
-059 : 43948641;
-05A : 06376085;
-05B : 05B74200;
-05C : 85134000;
-05D : 2E11F7C0;
-05E : 02D00313;
-05F : 25B743A1;
-060 : D63745C1;
-061 : 08B778DA;
-062 : 0D370200;
-063 : 84930080;
-064 : 86238641;
-065 : AA238661;
-066 : 4A858671;
-067 : 89134981;
-068 : 8A1386C1;
-069 : 0FB78741;
-06A : 5CFD4000;
-06B : BA158B93;
-06C : ECB60C13;
-06D : FFF88D93;
-06E : 84330D05;
-06F : 458101F9;
-070 : 20238522;
-071 : 2C090004;
-072 : 852255FD;
-073 : 01942023;
-074 : C5932421;
-075 : C00CFFF9;
-076 : 2AFD8522;
-077 : 852285CE;
-078 : 01342023;
-079 : 86B32AD5;
-07A : 85220379;
-07B : 018685B3;
-07C : 22DDC00C;
-07D : 00040E37;
-07E : FFFE0E93;
-07F : 01DAFF33;
-080 : 40000FB7;
-081 : 02D00513;
-082 : 000F1863;
-083 : 00094783;
-084 : C4F00023;
-085 : 00A90023;
-086 : 0004A083;
-087 : 99860A85;
-088 : 01B9F9B3;
-089 : F9AA9BE3;
-08A : 85136285;
-08B : 241DFB42;
-08C : 27374321;
-08D : D3B745C1;
-08E : 0CB778DA;
-08F : 05B70004;
-090 : 06370200;
-091 : 20230080;
-092 : 4981006A;
-093 : 0B934A05;
-094 : 8C13BA17;
-095 : 0D37ECB3;
-096 : 1CFD4000;
-097 : 02D00D93;
-098 : FFF58413;
-099 : 00160A93;
-09A : 03798833;
-09B : 01A98533;
-09C : 018805B3;
-09D : 78B32295;
-09E : 9863019A;
-09F : 46830008;
-0A0 : 00230009;
-0A1 : 0023C4D0;
-0A2 : AE0301B9;
-0A3 : 0A050004;
-0A4 : 41C98EB3;
-0A5 : 008EF9B3;
-0A6 : FD5A18E3;
-0A7 : C0102973;
-0A8 : 0F936F55;
-0A9 : 0B33820F;
-0AA : 55B34169;
-0AB : 650503FB;
-0AC : FE050513;
-0AD : 40080DB7;
-0AE : A2832AC9;
-0AF : 478D0004;
-0B0 : 400005B7;
-0B1 : 02578333;
-0B2 : 00837733;
-0B3 : 01735B93;
-0B4 : 017743B3;
-0B5 : FF83FC13;
-0B6 : 004C6D13;
-0B7 : 01A4A023;
-0B8 : DEADC4B7;
-0B9 : EEF48C93;
-0BA : A02380AE;
-0BB : 05910190;
-0BC : FFB59CE3;
-0BD : C0102473;
-0BE : 1406F637;
-0BF : 3FF60A93;
-0C0 : C0102873;
-0C1 : 408808B3;
-0C2 : FF1AFCE3;
-0C3 : 85136685;
-0C4 : 22890086;
-0C5 : C0102E73;
-0C6 : 00803EB7;
-0C7 : C7FE8993;
-0C8 : C0102A73;
-0C9 : 41CA0933;
-0CA : FF29FCE3;
-0CB : 20234B05;
-0CC : BFF5FD60;
-0CD : 00001197;
-0CE : 5D818193;
-0CF : 86C18513;
-0D0 : 8A418613;
-0D1 : 45818E09;
-0D2 : 05132A7D;
-0D3 : C5190000;
-0D4 : 00000513;
-0D5 : 00000097;
-0D6 : 000000E7;
-0D7 : 450222B1;
-0D8 : 4601004C;
-0D9 : A0A939F5;
-0DA : C4221141;
-0DB : 8881C783;
-0DC : EF91C606;
-0DD : 00000793;
-0DE : 6505CB81;
-0DF : 10050513;
-0E0 : 00000097;
-0E1 : 000000E7;
-0E2 : 84234785;
-0E3 : 40B288F1;
-0E4 : 01414422;
-0E5 : 07938082;
-0E6 : CB910000;
-0E7 : 85936505;
-0E8 : 051388C1;
-0E9 : 03171005;
-0EA : 00670000;
-0EB : 80820000;
-0EC : 01407737;
-0ED : 02934789;
-0EE : F693F3F7;
-0EF : 00230FF7;
-0F0 : C793C0D0;
-0F1 : 26730077;
-0F2 : 2373C010;
-0F3 : 03B3C010;
-0F4 : FCE340C3;
-0F5 : B7D5FE72;
-0F6 : 03634110;
-0F7 : 114104B6;
-0F8 : 8413C422;
-0F9 : 401C8741;
-0FA : CF89C606;
-0FB : 85AA86AE;
-0FC : 05136505;
-0FD : 2851F085;
-0FE : 00042283;
-0FF : FFF28313;
-100 : 00642023;
-101 : 87018593;
-102 : 07134190;
-103 : 06930580;
-104 : C1940016;
-105 : 86234422;
-106 : 40B286E1;
-107 : 80820141;
-108 : D7378082;
-109 : 478D3216;
-10A : 94870313;
-10B : 02A782B3;
-10C : 02653533;
-10D : 00A283B3;
-10E : FFF38593;
-10F : C4B02223;
-110 : 47A98082;
-111 : 00F51563;
-112 : 002342B5;
-113 : 0023C450;
-114 : 8082C4A0;
-115 : C4221141;
-116 : 842AC606;
-117 : 00044503;
-118 : 40B2E509;
-119 : 01414422;
-11A : 04058082;
-11B : B7FD3FD9;
-11C : 862A7175;
-11D : 850A86AE;
-11E : 08000593;
-11F : 28EDC706;
-120 : 3FC9850A;
-121 : 614940BA;
-122 : 71398082;
-123 : 104CD22E;
-124 : D432CE06;
-125 : D83AD636;
-126 : DC42DA3E;
-127 : C62EDE46;
-128 : 40F23FC1;
-129 : 80826121;
-12A : C4221141;
-12B : 6405C226;
-12C : 87936485;
-12D : 04131044;
-12E : 8C1D1044;
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+38B : 11018082;
+38C : 8493CA26;
+38D : CE060035;
+38E : FFC4F093;
+38F : CC22C84A;
+390 : 8493C64E;
+391 : 47B10080;
+392 : F663892A;
+393 : 44B104F4;
+394 : 04B4E563;
+395 : 22B5854A;
+396 : 87818713;
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+398 : 87818693;
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+39A : 87C18993;
+39B : 0009A303;
+39C : 00031763;
+39D : 854A4581;
+39E : A0232A31;
+39F : 85A600A9;
+3A0 : 2A09854A;
+3A1 : 116359FD;
+3A2 : 45310935;
+3A3 : 00A92023;
+3A4 : 2A0D854A;
+3A5 : DDE3A031;
+3A6 : 42B1FA04;
+3A7 : 00592023;
+3A8 : 40F24501;
+3A9 : 44D24462;
+3AA : 49B24942;
+3AB : 80826105;
+3AC : 8833400C;
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+3AE : 462D0408;
+3AF : 01067763;
+3B0 : 01042023;
+3B1 : C0049442;
+3B2 : 2E03A039;
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+3B5 : 854A01C6;
+3B6 : 0F1320F5;
+3B7 : 0E9300B4;
+3B8 : 75130044;
+3B9 : 0FB3FF8F;
+3BA : 0CE341D5;
+3BB : 00B3FBD5;
+3BC : 87B301F4;
+3BD : A02340AE;
+3BE : B76500F0;
+3BF : 01C8A223;
+3C0 : 88A2BFD9;
+3C1 : B7854040;
+3C2 : 00350393;
+3C3 : FFC3F413;
+3C4 : FA850BE3;
+3C5 : 40A405B3;
+3C6 : 28AD854A;
+3C7 : FB3515E3;
+3C8 : 1101B7AD;
+3C9 : CE06CC22;
+3CA : C84ACA26;
+3CB : C452C64E;
+3CC : E9918432;
+3CD : 40F24462;
+3CE : 494244D2;
+3CF : 4A2249B2;
+3D0 : 610585B2;
+3D1 : EE01B5ED;
+3D2 : 44813D19;
+3D3 : 446240F2;
+3D4 : 49B24942;
+3D5 : 85264A22;
+3D6 : 610544D2;
+3D7 : 8A2A8082;
+3D8 : 2095892E;
+3D9 : 676389AA;
+3DA : 57930085;
+3DB : 84CA0015;
+3DC : FC87EEE3;
+3DD : 855285A2;
+3DE : 84AA3D5D;
+3DF : 8622D961;
+3E0 : 0089F363;
+3E1 : 85CA864E;
+3E2 : 3B618526;
+3E3 : 855285CA;
+3E4 : BF6D33F9;
+3E5 : C4221141;
+3E6 : 842AC226;
+3E7 : C606852E;
+3E8 : 8801A023;
+3E9 : 57FD2825;
+3EA : 00F51863;
+3EB : 8801A083;
+3EC : 00008463;
+3ED : 00142023;
+3EE : 442240B2;
+3EF : 01414492;
+3F0 : 80828082;
+3F1 : A7838082;
+3F2 : 8513FFC5;
+3F3 : D663FFC7;
+3F4 : 95AA0007;
+3F5 : 0005A283;
+3F6 : 80829516;
+3F7 : 87931141;
+3F8 : C6068841;
+3F9 : 0007A083;
+3FA : 829386AA;
+3FB : 93638841;
+3FC : 08930200;
+3FD : 45010D60;
+3FE : 00000073;
+3FF : 1963537D;
+400 : 28050065;
+401 : C1104631;
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+403 : 80820141;
+404 : 00A2A023;
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+40A : A023FCB5;
+40B : 851E00A2;
+40C : A503BFE9;
+40D : 80828681;
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+40F : 72203A20;
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+416 : 00000000;
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+419 : 706F6F6C;
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+41B : 0000000A;
+41C : 41524453;
+41D : 6F64204D;
+41E : 6F6C6E77;
+41F : 74206461;
+420 : 206B6F6F;
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+423 : 252F7525;
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+429 : 30252E78;
+42A : 00007834;
+42B : 74736554;
+42C : 20676E69;
+42D : 41524453;
+42E : 7266204D;
+42F : 30206D6F;
+430 : 38302578;
+431 : 6F742078;
+432 : 25783020;
+433 : 2C783830;
+434 : 72747320;
+435 : 20656469;
+436 : 30257830;
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+43B : 61622067;
+43C : 74206B63;
+43D : 6863206F;
+43E : 206B6365;
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-44C : 00000000;
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+44B : 20752520;
+44C : 0A0D736D;
 44D : 00000000;
-44E : 00000000;
-44F : 00000000;
-450 : 00000000;
-451 : 00000000;
-452 : 00000000;
-453 : 00000000;
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-456 : 00000000;
-457 : 00000000;
-458 : 00000000;
-459 : 00000000;
-45A : 00000000;
-45B : 00000001;
-45C : 00000004;
-45D : 0000110C;
-[45E..7FF] : 00;
+44E : 202A2A2A;
+44F : 6E696F44;
+450 : 65722067;
+451 : 20746573;
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+45A : 69460A0D;
+45B : 61776D72;
+45C : 63206572;
+45D : 69706D6F;
+45E : 2064656C;
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+4A3 : 00000000;
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+4A5 : 00000000;
+4A6 : 00000000;
+4A7 : 00000001;
+4A8 : 00000004;
+4A9 : 0000123C;
+[4AA..7FF] : 00;
 END;

fw/console.c

@@ -26,7 +26,9 @@ void con_set_baudrate(uint32_t b)
 
 void con_putc(char c)
 {
-    /* XXX: need status register to delay on FIFO full */
+    while (CON_STATUS & (1 << 4))
+	/* wait for FIFO to drain some */
+	;
     if (c == '\n')
 	CONSOLE = '\r';
     CONSOLE = c;

fw/hello.c

@@ -87,7 +87,7 @@ static void test_sdram(void)
     }
 
     con_printf("\rSDRAM test complete, time = %u ms\r\n",
-	       (rdtime() - start_time)/(CPU_CLK_HZ/1000));
+	       (rdtime() - start_time)/(CPU_HZ/1000));
 
     stride *= 3;
     stride = (stride & SDRAM_MASK) ^ (stride >> (SDRAM_ADDR_BITS-2));
@@ -119,7 +119,7 @@ void main(void)
     con_puts(hello);
 
     con_printf("This is loop: %u\n", loops++);
-    con_printf("SDRAM download took %u us\n", done/(CPU_CLK_HZ/1000000));
+    con_printf("SDRAM download took %u us\n", done/(CPU_HZ/1000000));
 
     volatile uint32_t *p = (uint32_t *)SDRAM_ADDR;
     const unsigned int words = 128*1024;
@@ -143,7 +143,6 @@ void main(void)
 	    con_printf(" %04x.%04x", l, h);
 	}
 	con_putc('\n');
-	udelay(8000);
     }
 
     test_sdram();

fw/io.h

@@ -28,7 +28,7 @@ static inline uint64_t rdtimeq(void)
 
 static inline void udelay(uint32_t us)
 {
-    uint32_t cycles = us * (CPU_CLK_HZ / 1000000);
+    uint32_t cycles = us * (CPU_HZ / 1000000);
     uint32_t start = rdtime();
 
     while (rdtime() - start < cycles)

fw/iodev.h

@@ -34,16 +34,20 @@
 
 #endif
 
-#define CPU_CLK_HZ	84000000
+#define CPU_HZ		84000000
 
 #define LED		IODEVB(0,0)
-#define CONSOLE		IODEVB(1,0)
-#define CON_BAUDDIV	IODEVL(1,1)
-#define CON_BAUD_BASE	(84000000U >> 4)
-#define CON_BAUD_BITS	24
 
-#define ROMCOPY_DONE	IODEVL(2,0)
+#define RESET_CMD	IODEVL(1,0)
+
+#define ROMCOPY_DONE	IODEVRL(2,0)
 
-#define RESET_CMD	IODEVL(15,0)
+#define CONSOLE		IODEVB(3,0)
+#define CON_BAUDDIV	IODEVL(3,1)
+#define CON_BAUD_BASE	(CPU_HZ >> 4)
+#define CON_BAUD_BITS	24
+#define CON_STATUS	IODEVRL(3,2)
+#define CON_IRQEN	IODEVL(3,3)
 
 #endif /* IODEV_H */
+