 H. Peter Anvin
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b2d184d021
Fix polarity of output SDRAM clock; move into sdram module
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hace 3 años |
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H. Peter Anvin
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30d5acc569
Change core clock to 168 MHz and video clock to 48 MHz
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hace 3 años |
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H. Peter Anvin
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afc9429471
Add simple SDRAM controller
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hace 3 años |
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H. Peter Anvin
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43d9806872
Remove unused assignments; use a DDIO buffer for sr_clk
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hace 3 años |
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H. Peter Anvin
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8d356f7502
Automate jic file generation
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hace 3 años |
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H. Peter Anvin
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7522b73a70
Update configuration assigments, JIC generation
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hace 3 años |
